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標題: design through verilog HDL [打印本頁]
作者: jearome    時間: 2008-1-17 05:23 PM
標題: design through verilog HDL
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, e3 J2 O" ~; L1 q2 ]a very nice book![local]1[/local]
作者: cmyang    時間: 2008-1-21 09:20 AM
我好想要看看, 不知要如何得到呢?



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