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標題:
請教FPGA差動輸出的問題
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作者:
kokonut
時間:
2009-4-28 07:53 PM
標題:
請教FPGA差動輸出的問題
大家好
3 n0 Z* T" c v7 z# v/ ?& c
' r# x( A9 d5 Y- k
想請問一下
" L: m3 K2 Y3 |) X$ r
( ]. _+ q% W% ~7 j& U* S7 Y
現在我的FPGA外接4組driver IC
. F7 T$ ]7 }, B; Y0 e5 T" e
8 ]0 ?8 h/ i1 t3 J2 R- K0 E9 N5 L/ X/ U
此IC為differential type的輸入
; e1 t7 X- N9 H! O7 Z7 M5 o' y
1 U& U% K8 [, O x8 s
( H- W. I. y7 s$ _2 V
我現在每一筆控制data為4bits (期望能操作在500MHz以上)
& m* ` m5 [. K1 m
+ S$ u) M$ I' J; }) @; c7 p3 `% i1 n5 v
每一個bit分別同步控制一組driver IC
_; _" c5 V1 l$ }
4 m5 }& o x {7 o( N# G2 ^5 R4 o2 f
; N1 f2 s2 N* h% v
我想請問一下
& l) y) b1 I8 {) P2 z$ G+ H* o
/ C2 q. \1 m, U# i3 p
我想把每一個bit在送到driver IC之前
. }( C% F- p( v$ Z
/ L; ^* ^! k1 V- i6 l1 G, S! r$ Z
先轉成differential mode
- n: ]+ K# a6 H6 V: H7 i' a
( f3 }* u- ]( i
# H9 M; j% d3 U2 p: V. j
我現在的想法是
8 H4 ?# H1 D1 R. ^* v" f2 a1 m
( B1 s- ~- c% e" h: ?" v1 K
寫個differential mode 的module
+ a z y9 m; `1 W7 B- F. z
) j" N, v. { o+ W3 y6 V4 C# p
此module很簡單
" Z' C0 F& }4 f9 L( x
; M8 Y! q, V; P
為單一輸入
3 F: ?/ u$ x4 f! }3 K2 ]9 k
' ]# b9 {( P+ P' m* u X, a4 w
經過一個buffer 與 一個反向器
- Q: ~3 r/ m1 d {/ ^
$ e. u X5 X1 Z9 ?5 s# ~
的雙輸出
0 u) t. a2 {5 x% U8 ?
2 t4 |; \/ o3 H* J2 ^" L, }
: H8 f0 G* o0 e8 l, H0 ~/ f
q1 a$ j# D3 O3 y2 n8 g
. c# G& r' a, n3 K4 Q! a
感謝
作者:
tommywgt
時間:
2009-4-28 10:31 PM
請使用DDR的IOB並把IO type設定成LVDS即可
+ m5 J/ `4 P9 d' x* d% p
不需要特別去設計一個module
作者:
videochip
時間:
2009-5-6 06:41 PM
直接使用的話，skew 的問題要特別考慮
, o% r* f( j. z6 ]* K
另，一般 fpga，有現成的 differential io 可以用
; x$ D8 A/ ~4 }
不過如果是 500 MHZ 的話，可能要挑一下了 ???
作者:
fjuphilip
時間:
2009-8-17 10:52 AM
千萬不能這樣用
2 ~! L! B9 l7 f% ~6 z2 V1 m7 s
在高蘋上面你必須考慮兩個部份
# q$ \( I( B' g+ ?" `
外部PCB必須等長
( R# r" L5 _0 f( o8 y9 f
內部在LVDS buffer 之前的routing
3 z4 r+ m" ^& V' m3 C
不然你會q到死
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