请教各位，关于testbench和modelsim问题

jearome · 發表於 2008-5-4 09:27:18

各位大哥，小弟目前有两个问题请教大家
1.大家有没有使用modesim的资料，比如好的电子教材等
2.大家关于如何用verilog写testbench有没有什么好的建议和资料

谢谢各位！

jearome · 發表於 2008-5-4 12:47:00

如果哪位知道，劳驾回复一下，或者加我的msn： hanzhir8461cn@hotmail.com

jearome · 發表於 2008-5-5 12:54:32

不会吧，大家都不会，还是因为我的问题太简单？

jearome · 發表於 2008-7-29 14:54:24

其实我很想看你们那边出的一本书 Verilog晶片設計：使用 ModelSim(附光碟) 但是大陆这边没有卖，郁闷

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