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因為 SystemC 可以囊括 high level abstraction 從 behavior -> transaction -> RTL, 所以學習 SystemC 可以從目的來分類:3 J. b& _, U* d, i
/ H3 S1 p' j- e
如果你想做的是 RTL/testbench writig.+ x- H2 _( N% Q$ p8 T% V6 S
底下這一本提供一組 SystemC 在語法上的 subset, 可以說是把 SystemC 當做 Verilog 來用:
, Q) L. Z8 O' d" j; l. K) v" Z6 d"A SystemC Primer," by J. Bhasker
5 G) `( K8 L! c/ j6 B+ ]4 o& X( z7 i' }3 k
如果你想做的是 modeling/TLM.: S, ~6 I% D& x! z- t4 f- m
這邊難的地方在於會用到大量 C++ 的 class, template, 以及 object oriented 的觀念, 強烈建議要對 C++ 的 OOP 有點觀念:
7 t6 w t. s ]. [/ R( {"SystemC: From The Ground Up," by David C. Black and Jack Donovan9 ~# u6 T4 p4 \5 b, m
"System Design with SystemC," by Thorsten Grotker, Stan Liao, Grant Martin, Stuart Swan
. Z- G4 s$ S% W
# m: s9 R9 U, i! ~3 w一般 research.
$ W. L5 l1 u- m- \0 {包含較多觀念, platform, simulator kernel, simulation speed, verification 的探討:/ L" |1 w# ^% _: R) i/ q: C
"Systemc: Methodologies and Applications," by Wolfgang Muller, Wolfgang Rosenstiel, Jurgen Ruf- o- S# T; C. `2 z" G- _! I2 V
"Transaction-Level Modeling with SystemC: TLM Concepts and Applications for Embedded Systems," by Frank Ghenassia
; F5 b% \6 K) N3 o/ N* u0 }- `
3 U1 H- t4 f5 g' I" kSystemC 相關的 spec. g% @( p9 E6 Z2 g0 ]
如果要 implement hierarchical channel, 光靠 "SystemC: From The Ground Up" 我想可能不夠, IEEE 1666 SystemC LRM 可能可以協助更了解每個所用到的 class, 以及各個 class 間的 relationship. TLM-2.0 目前有 OCP-IP 和 Greenbus 已經採用 (commercial tool 的 bus model 可能也有用). SCV 我個人尚未成功 compile, 可能麻煩其它先進補充 :( C+ N9 A7 X3 o+ E- d6 V
IEEE 1666-2005 Standard SystemC Language Reference Manual (LRM)
1 V* [% w$ x- R, A. E1 b/ k3 hOSCI TLM-2.0 USER MANUAL; D0 G0 Y6 p; N" e
SystemC Verification Library (SCV)! I5 C' C0 U, j, J H
上面三個都可以由這個網址下載: http://www.systemc.org/downloads/standards/ |
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