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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › latch up
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樓主: YuanII
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[問題求助] latch up

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Rexcchao
1#
發表於 2012-10-24 00:46:03 | 顯示全部樓層
不清楚一些部分
. X( v8 T* E* k" O4 C) D/ q如果我是LAY OP第一級  是否要考量LATCHUP 問題5 ~- H$ i) P2 O2 ~- s$ J5 m

- r) [( l/ ?! r$ g5 \6 x7 ]* B6 L而把PN MOS距離拉遠  這樣缺點是會使訊號線拉長照成MIS MATCH機會上升. V, Z0 i# P7 _

/ j: x- _; S: W' U! R8 i" S( D如果mismatch 為首要考量的話，我應該怎模作呢??
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