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樓主: kyokanasaki
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[市場探討] 眾人都會IC設計

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21#
發表於 2010-10-10 15:12:07 | 只看該作者
even 是digital IC4 M2 _9 o- V  W, ?* d. h
說難不難,說容易也不容易,7 B* J% i3 M0 x5 d) B: f1 d
會做的還是缺創意
22#
發表於 2010-10-25 08:10:05 | 只看該作者
編輯觀點:你是否樂見下一代也投身工程師職業? ) M# z" e5 y, ]$ p
電子工程專輯 - ‎2010年10月21日‎% y- v$ K# \* |, l: ]( ^  @4 J
( W. [6 _1 u; b# ^* d
我們常聽EETimes的電子工程師讀者聊到,他們打算阻止自己的子女未來從事相同職業,所持的理由很多種,但大多數人的結論是,在全球化的趨勢下,當工程師幾乎不可能成就一番大事業,也越來越難餬口。 這真是很悲哀…其中一個可能導致的結果,是讓大量人才轉向投入金融服務等 ...
23#
發表於 2010-11-14 12:16:57 | 只看該作者
官大學問大!. N; ?/ n+ P: S  k; ]" O
應該說眾老闆(含教授及主管)都會IC設計,; k; f3 {' i: j8 E
因為他們的知識大多來自下屬及學生的報告,: m3 m8 Q3 Y( \* U
老闆每次都跟客戶吹牛他設計的電路有多難,4 V7 \6 a: k' m  h
實際上那電路根本都是他的工程師幫他設計的.
24#
發表於 2010-11-17 11:35:29 | 只看該作者
回復 23# liger
  O; w2 p' H& D) ]9 ]: j- A. n" M5 g
' t( H4 e, G' m& Y' Q
! ?4 y' ]: s% _0 v; e& q也不全然是這樣, 也許您待的是大公司吧?!
) g1 ?8 \1 T! {- b. G若是待start-up, 主管沒一定本事可是沒人會去挖角的....# ?/ F  [7 Z5 ^0 n* }
IC設計的功力, 最基本的電路部份有了一定修為之後, 差別就在debug的能力了
: s1 }3 U# b, V% W這部份得靠經驗累積....
25#
發表於 2010-12-8 17:02:12 | 只看該作者
感謝24#前輩的回復,的確我的講法有點一概而論,2 C) ]: Z2 M4 h6 U
不過通常會出來開design house大多是數位領域出身的老前輩,; X- Z. [& Y$ S
所以是否為類比人才他跟本沒有能力去判斷,3 t: I5 O& ^, N0 i/ d
且自己很愛面子,以吐嘈別人來裝懂,甚至還會說數位比類比難,
7 k( ?: I& Z4 |/ G下屬還要裝作很受教的樣子.4 W- C0 L  \9 D. j
累.....(沒辦法花錢是大爺嘛)
26#
發表於 2010-12-30 08:51:58 | 只看該作者
主要看自己是否喜欢,有多大的把握可以做好!
27#
發表於 2010-12-31 08:57:14 | 只看該作者
非常贊同15樓的說法,不見得是資工的,即便是EE科班的也有很多會一些logic就以為自己多強,0 Q3 c4 f0 W$ E! T% i9 W
只是一些騙女生的把戲而已,說實在的真的要訓練一個數位工程師只要三個月的時間.
28#
發表於 2011-1-14 00:04:18 | 只看該作者
微电子设计需要研究所的水平吧 在下严重感觉这样
29#
發表於 2011-1-22 04:30:34 | 只看該作者
说IC设计简单 如果是资深前辈 当然有不同的见地; 如果想做科技攻关, 有能力的话就不会在这里侃侃而谈了吧.
30#
發表於 2011-3-12 09:03:32 | 只看該作者
我適感覺順其自然~
' H! P- i9 M! [+ F* G1 h% r當你能力夠 又強
& G, }9 G5 [& q" c! _- f4 u( P: c0 Z% c* T老闆當然會讓你起來
31#
發表於 2011-4-6 18:18:12 | 只看該作者
我是數學系畢業的, 於民國90年轉入IC設計,
: V8 Q6 i# M( e2 E9 b8 Z: q撰寫Verilog確實不難, 大約半年就可出師了,
" l8 j7 u, b% e又加上有FPGA可以驗證, 所以出錯的機率著實不高,
) C& b9 q& l+ O2 Z但那只能說function work, 要達到量產, 還有一段距離,# z7 F; x( i5 |; {
以下是我經驗:& r3 z& K- s/ ]/ k% q' l' s
1. 現在的IC不可能是純數位, 所以會有analog circuit在IC中,
: e2 e& X: Q9 l) V    最難的就是analog與digital interface,
% K2 a& b# d0 q0 g& K9 Y5 w# {    常常就是analog simulation ok, digital用FPGA verification也ok,9 {7 P9 m: H3 x7 o
    但實際開出IC卻有問題, 而且弄不清楚是analog還是digital.
; }8 x$ B: d! m$ {% `6 P$ a2. 現在IC cost-down很嚴重, 所以Verilog大家都會寫,0 z' p/ H# |7 A
    但要怎麼把die size縮小, 那就是一門學問了.1 T1 T/ u% A9 s# L7 x2 K
3. 測試又是另一個問題, 雖然有tool可以產生test-pattern,/ k1 d4 W) z2 B, Z4 `& u
    但要怎麼把測試的覆蓋率提高, 又是個挑戰.# [9 l+ v. {3 O/ n
4. 另外, 還有一個重要的課題...EMC,
1 n2 z$ ^" ?3 p+ Z1 ^- n0 q$ k    這個就要有很多的經驗值了, 因為都是要IC出來後才知好壞.' B  F; e2 t) R$ z$ \* `3 |
5. 最後, 雖然有tool能修改code降低power consumption,7 e" Y$ V/ v5 @  o/ l7 H/ T
    但不注意對正常function有時會影響到, 所以需要一些經驗值.  i; E; M- P: p' U2 ~& }
以上就是我的看法, 給大家參考.
32#
發表於 2012-4-17 17:43:51 | 只看該作者
回復 10# jasonlhb
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