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樓主: kyokanasaki
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[市場探討] 眾人都會IC設計

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21#
發表於 2010-10-10 15:12:07 | 只看該作者
even 是digital IC
( a& I! B, }# ]說難不難,說容易也不容易,
+ K8 K% b" H$ O2 W  Q會做的還是缺創意
22#
發表於 2010-10-25 08:10:05 | 只看該作者
編輯觀點:你是否樂見下一代也投身工程師職業?
  j* r' t* T( _8 P# X3 j電子工程專輯 - ‎2010年10月21日‎
2 O" B* p5 X, \) r, d9 H1 A6 P6 A! N- _: ^
我們常聽EETimes的電子工程師讀者聊到,他們打算阻止自己的子女未來從事相同職業,所持的理由很多種,但大多數人的結論是,在全球化的趨勢下,當工程師幾乎不可能成就一番大事業,也越來越難餬口。 這真是很悲哀…其中一個可能導致的結果,是讓大量人才轉向投入金融服務等 ...
23#
發表於 2010-11-14 12:16:57 | 只看該作者
官大學問大!2 i' }: N2 ?. K9 Z
應該說眾老闆(含教授及主管)都會IC設計,  ^4 @# Y+ b4 w1 G5 e5 N+ {. D
因為他們的知識大多來自下屬及學生的報告,
( Z2 i3 \+ ?0 O! j) R. `老闆每次都跟客戶吹牛他設計的電路有多難,
0 }7 ?: p, ]4 h3 w實際上那電路根本都是他的工程師幫他設計的.
24#
發表於 2010-11-17 11:35:29 | 只看該作者
回復 23# liger
- B: B* y# B4 l2 ]3 G
2 q& h( u% e  O. u
0 f. b  p9 _+ J, m也不全然是這樣, 也許您待的是大公司吧?!7 p" b& U/ d5 B" X* H, I  \
若是待start-up, 主管沒一定本事可是沒人會去挖角的....
' b/ B3 ], U" y# Z4 ^% ]IC設計的功力, 最基本的電路部份有了一定修為之後, 差別就在debug的能力了
6 r& F& X* v9 k& a) T這部份得靠經驗累積....
25#
發表於 2010-12-8 17:02:12 | 只看該作者
感謝24#前輩的回復,的確我的講法有點一概而論,( J8 |8 T, U, Y) F3 u' k
不過通常會出來開design house大多是數位領域出身的老前輩,
: a1 t5 ^/ W$ E3 g, [  X; A所以是否為類比人才他跟本沒有能力去判斷,. E# F) p/ B- r5 S
且自己很愛面子,以吐嘈別人來裝懂,甚至還會說數位比類比難,$ {) v+ X. s8 C5 z: ]- M
下屬還要裝作很受教的樣子.3 K* Q( g! B* E+ L
累.....(沒辦法花錢是大爺嘛)
26#
發表於 2010-12-30 08:51:58 | 只看該作者
主要看自己是否喜欢,有多大的把握可以做好!
27#
發表於 2010-12-31 08:57:14 | 只看該作者
非常贊同15樓的說法,不見得是資工的,即便是EE科班的也有很多會一些logic就以為自己多強,
1 {1 A* w0 r, D1 y, B只是一些騙女生的把戲而已,說實在的真的要訓練一個數位工程師只要三個月的時間.
28#
發表於 2011-1-14 00:04:18 | 只看該作者
微电子设计需要研究所的水平吧 在下严重感觉这样
29#
發表於 2011-1-22 04:30:34 | 只看該作者
说IC设计简单 如果是资深前辈 当然有不同的见地; 如果想做科技攻关, 有能力的话就不会在这里侃侃而谈了吧.
30#
發表於 2011-3-12 09:03:32 | 只看該作者
我適感覺順其自然~  z4 k, \- f! A7 L% l
當你能力夠 又強% x; C' ?6 U, B+ P, @7 @1 o3 ]
老闆當然會讓你起來
31#
發表於 2011-4-6 18:18:12 | 只看該作者
我是數學系畢業的, 於民國90年轉入IC設計,
7 v3 s" U' _+ V2 k( j) E) ^撰寫Verilog確實不難, 大約半年就可出師了,+ b+ S7 f8 [# a% c' L
又加上有FPGA可以驗證, 所以出錯的機率著實不高,
; n$ x: m7 b3 N8 b/ h5 s5 V但那只能說function work, 要達到量產, 還有一段距離,
( g% m% s- b4 K' m- q4 F以下是我經驗:
' R& f2 \, z+ B7 K( R1. 現在的IC不可能是純數位, 所以會有analog circuit在IC中,
5 n" f1 I. R* D; Q/ j    最難的就是analog與digital interface,
3 o. {  u. D3 V4 a; {    常常就是analog simulation ok, digital用FPGA verification也ok,
/ y6 Z" e- r  E1 t- y& M    但實際開出IC卻有問題, 而且弄不清楚是analog還是digital.
+ y4 Y1 o! t: B1 N; H2. 現在IC cost-down很嚴重, 所以Verilog大家都會寫,+ M# t* v7 b4 Y7 f6 d; z
    但要怎麼把die size縮小, 那就是一門學問了.
6 k5 r8 ^. N% x/ M# }3. 測試又是另一個問題, 雖然有tool可以產生test-pattern,3 _" X0 `, U4 ?9 A: N, |! q
    但要怎麼把測試的覆蓋率提高, 又是個挑戰.
# m( x2 U& p5 |2 `6 @& [7 f4. 另外, 還有一個重要的課題...EMC,
  t  ]# ?- Y8 N- e+ i- y/ a    這個就要有很多的經驗值了, 因為都是要IC出來後才知好壞.
2 A$ i* l% w! y( t0 @& l6 \/ _" b5. 最後, 雖然有tool能修改code降低power consumption,
& U, H3 G+ z. _$ ?2 C7 f    但不注意對正常function有時會影響到, 所以需要一些經驗值.
$ {& ]2 K! Q% o6 y5 b. t4 }以上就是我的看法, 給大家參考.
32#
發表於 2012-4-17 17:43:51 | 只看該作者
回復 10# jasonlhb
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