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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積
" {: i' |1 f1 q7 }, ^2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流# r9 o( D" n+ k5 C; e8 w9 n
3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠0 L1 @! w7 O, y9 _
你勉強把東西 塞進去之後  好不容易做完1 n) i: ?0 X4 q6 M) _# j" B
結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說. l* u9 a! S6 B( r7 b6 Q; {
一直改圖對LAYOUT來說是最花時間的
0 Q6 Y. L0 g, A. w9 Z/ x( \或者是 沒有看清楚 RD寫的NOTE
. u( B2 t( ]$ z% P, I) H導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的7 U) O) d% G! n6 g( ~; F  x# |+ f

$ D. k; x8 v* v有時候我們公司RD也不想讓LAYOUT一直改
' c& `9 U( Z8 I* c& k- O, s只是因為有時專案太趕" ^$ ?8 l4 O2 W* T8 ]6 T( b
所以只好跟LAYOUT同時平行做
0 E) I3 C1 c5 x: A- r( a這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~  {0 g8 x: I7 P- `
光是排列就會影響後續走線7 [+ U1 K+ v  i
所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
% M* k" G3 ]# ~3 e最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖6 [* ]& P& P) ^. t/ M
然後整個的大小不變，但是改的地方，又比原來的大一些3 ]& G$ c0 j3 G9 o
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
6 X2 G( b* A+ }2 z5 B7 {1 l8 [0 H3 M2 j5 K& m) V
我花最多時間的是在思考，
; o7 h8 [, E& M) h一個5天該完成的案子，我可能會花去2~3天思考。8 S/ p3 ]- J3 N; F1 X
事前想的仔細，
! k0 }5 [3 ?& G開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！2 X+ a+ N4 L4 s' K
整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順7 a; M1 ], w% R* c2 s8 t2 n2 b3 _8 V
我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎8 m: M* Y0 h  f% V( \: K6 @
LAYOUT我覺得每項都很花時間
& q6 \2 ]; t+ h( L, Q不管是佈局還是LVS/DRC
- c4 Y. C! F' F; e2 }- W% U/ x每項都得小心翼翼) G: M5 N# k- d# j% r( k
做快不見得好
5 |$ a6 N) N. F4 h; {" ~! X0 f做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~
- w$ {# C7 w& ^% P& T$ @因要如何將每個block充分擺到適當的位子~- X1 I# M2 z! }, E$ f& M
這是一種學問~$ L! w. J; x% v$ e) {9 ~( @
因擺的好的話~
: m! ~0 v, q, r其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
* u' b9 f3 I& }$ P* R% r5 _- k6.  整合 Chip Integration$ k  s6 r  A% l. T& w% t
7.  溝通 communication
% ]4 c5 |- j/ u! _' \2 r% c這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧" ~. ^1 ?; S6 V& R
! Q" G. e3 Y& J, b
在layout初期就要花很多時間先想好如何排列
" Z9 V% M+ x5 [* u6 |% I! e$ Y# |9 a* x/ y5 C* M/ F5 m% M5 j/ {
想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...  {5 s5 {& T" N# K
要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
$ W# }- Y8 n2 n- @7 W8 O/ a) T( l6 m# K, H0 r+ k8 a2 w0 ]
其他就會很快   相對LVS 問題也比較好除錯0 B' V# s3 o" Y2 L( X
0 y- S" c5 j6 ~& A# ]* n
HR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
" k9 d' g" P& n8 W再整合時也會是另一個問題
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