可程式化計數計時器8254問題

addn

各位大大
6 W1 v" y3 t# Z( ^" t# |) c
4 l6 ^4 l( ]# [9 ~& w$ ?我看書上說回讀或鎖住命令,可以在計數時的任何一時間點栓鎖計數值

2 L6 M  S; A$ y/ `7 j; t% k# W5 l可是這樣在下列狀況下,難道不會栓鎖到錯誤的值嗎
* g% ^! O2 r% {7 `. N- y% _  \
9 l7 K/ s# }% q& J" {) j

+ Q: k- y9 l( x' _- A謝謝

addn

各位 大大

' N; Q$ b) W8 ~& S請問關於8254時序Tcl的意思是什麼呢,
看完他的文字敘述還是搞不懂,
: `; {5 y: M5 I- N# g* O) FTcl: min-40ns,max45n是不是說寫入鎖住命令/wr上緣,要介於clk下緣算起
0 I0 W/ x+ h! F1 E6 O' S4 n的-40ns~45ns的時間區間,低於或超過不行呢
7 Z. b* C1 a$ [  d8 o7 t# B
# X: k/ t5 e* U

謝謝

tommywgt

一個星期的問題囉, 沒人回答嗎?
jason_lin大大有空回答一下嗎?

jason_lin

我不知道8254的timingㄝ,不過一般SPEC.限制min跟max是有他一定的道理,過小或過大會latch 不到Data,
你上圖的例子,既然是set up time,就是一定要按照Spec.上定的,不然會latch不到資料,也就是說WR做write時,會write不到資料.^^

addn

謝謝各位大大回覆

# H" E) q' H! F9 |請問如下圖那是哪一段時間區間才可以latch計數值呢
還有第二篇圖那一段文字敘述又代表什麼意思呢
/ H4 v* }, G' O, i1 g3 k+ C: m3 I' I
  I9 O! H* y2 n# I謝謝

masonchung

把#1圖和#2圖對照一下
# T7 a; f! J1 m* M8 V9 V+ s+ D% S就知道為啥是這樣子囉
#1圖的答案就在#5你自己問的問題中
因為clk下緣會造成Counter變化
: o! i  \9 ^- ]9 j* n; P所以紅色區域不能為/wr的上緣
; F/ L( V7 H) [6 h- d* i0 ^! X$ i會Latch到不確定的值

[ 本帖最後由 masonchung 於 2007-5-11 12:54 AM 編輯 ]

addn

原帖由 masonchung 於 2007-5-11 12:47 AM 發表
把#1圖和#2圖對照一下
就知道為啥是這樣子囉
9 e8 i3 t  N9 p4 e#1圖的答案就在#5你自己問的問題中
- g5 Z% o" k" g4 z5 S% J( Y) M; ]因為clk下緣會造成Counter變化
所以紅色區域不能為/wr的上緣
會Latch到不確定的值

$ _+ G" k, f# H. o1 m% X; P
您好
我也是這樣認為,可是不太確定所以上論壇跟各位大大請教

! W5 p+ T3 J5 v, `; l3 F6 l+ t( e1.
$ W  F. i8 B# Z6 C1 h5 }   如此那書上的敘述"可以在任何時間點,去下鎖住命令"這句話不就是錯誤的??
2.
' z+ b- I- x& d) R   一般在操作8254時,/wr並不會與clk同步,請問那要怎處理latch到錯誤值問題呢??
3.
   8254 datasheet裡的一段文字
% U: F/ [7 A; q" I5 |  E. G  "If CLK present when writing a Counter latch or ReadBack Command,
0 q7 L- h; @* L   at TCL min CLK will be reflected in count value latched,at TCL max
# [1 P8 i& v8 A3 _( S$ p   CLK will not reflected in count value lached."
2 S$ f5 m* a; G; f   請問這段文字是什麼意思呢??
' @' S& n+ E  A' \
3 j5 V* d2 B+ |' V3 \- ~謝謝

masonchung

把軟體和硬體所能做的事混在一起的話,好像就弄不清楚囉∼
+ p' k* x9 D8 l3 I% M& n1. ==> 軟體命令 在 /WR (硬體訊號＝0）時當然可以任何時間下鎖住命令(軟體命令） Latch值
* d, F1 d3 m% C+ p2. ==> 硬體設計解決
3. 這個還需配合Latch Enable 的訊號(Gate？）才知道
" O  q4 ]4 V3 T3 C+ q, H, i! k1 B% E
其實我也沒仔細看過8254只是實驗課有寫一下程式去控制一下
但是真的這些IC的SPEC是給外面的應用電路來參考時序圖
除非把8254的內部電路展開,我們才能說明這個時序圖
. V1 |1 w) M4 I* g+ I7 v
4 {0 h7 O6 [0 K2 N, J# t1 e[ 本帖最後由 masonchung 於 2007-5-11 09:40 PM 編輯 ]

masonchung

If CLK present when writing a Counter latch or ReadBack Command,
# R+ s1 r* u6 ~at TCL min CLK will be reflected in count value latched ==> TCL 為負值 ,counter 正要開始變化, Latch值為舊值
5 Z( l2 W" {& {/ T: R' }. i2 [- E5 wat TCL maxCLK will not reflected in count value lached.==> TCL 為正值 ,counter 正在變化中, Latch值不確定
& q2 j$ B# G  E  x
. S7 }! }( u2 W$ z' ]∼這樣應該很清楚了
: k# K% \- D; V: ]
0 c( t4 t8 X  \' x9 @[ 本帖最後由 masonchung 於 2007-5-11 10:39 PM 編輯 ]

addn

原帖由 masonchung 於 2007-5-11 09:06 PM 發表
把軟體和硬體所能做的事混在一起的話,好像就弄不清楚囉∼
1. ==> 軟體命令 在 /WR (硬體訊號＝0）時當然可以任何時間下鎖住命令(軟體命令） Latch值
$ S( m  }9 K5 v/ }& ~2 j2. ==> 硬體設計解決
6 L: o% N% z+ C+ Z3. 這個還需配合Latch Enable 的訊號 ...

' N; u5 K0 n6 Z. J
板主大大您好
3 Y7 r% M/ o  }! a, }
% c- [. {" d# Z我還是不明白"軟體命令 在 /WR (硬體訊號＝0）時當然可以任何時間下鎖住命令(軟體命令） Latch值"
! |0 C! e* q4 k. ~: t9 R, g- D的意思

+ f3 {" e$ k& b% Q/ Z假設用51來控制8254,且51的系統CLK與8254的CLK不同步,
當51下鎖住命令時8254的CLK還是繼續在跑阿,51根本不知道
3 ]+ P- ~. I/ e2 z( v. D/ a! c8254的CLOCK現在是什麼狀況,不會有剛好鎖到不確定值的狀況嗎???
(/WR上緣剛好落在tCL MIN-40~MAX45的區間內)
. l. q& B0 j0 N6 x5 m7 V( |' ?
+ m' I8 D4 a# K$ X9 T) W) n
- u( L# n8 t& X5 U( d& T" a可惜8254的DATASHEET裡面沒有詳細完整的內部構造電路圖
* A& A5 Z$ g2 s1 d8 x
我以前有用VHDL來寫8254的功能,可是在LATCH這部分的控制總覺得怪怪的
上GOOGLE搜尋也找不到相關的詳細參考電路或設計

masonchung

意思就是只有在 /WR =0 時 控制字組 D7~D0 才有意義
(/WR上緣剛好落在tCL MIN-40~MAX45的區間內)＝＝>這個是在考慮8254外部電路訊號的設計,不允許的狀況
所以,CLK可以不一樣嘛?
* S9 X$ b0 b0 K6 o對了,LATCH_EN 你可以研究一下 就知道有無TCL時序限制

0 X, a9 Z: k4 z9 O5 a[ 本帖最後由 masonchung 於 2007-5-11 10:50 PM 編輯 ]

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原帖由 masonchung 於 2007-5-11 10:45 PM 發表
! l( C/ |5 u8 U# Z/ h意思就是只有在 /WR =0 時 控制字組 D7~D0 才有意義
(/WR上緣剛好落在tCL MIN-40~MAX45的區間內)＝＝>這個是在考慮8254外部電路訊號的設計,不允許的狀況
* q2 p+ h0 y0 H8 C所以,CLK可以不一樣嘛?
) ^8 P- o' E9 q& Q3 h3 T對了,LATCH_EN 你可以研究一下 ...

  M  P: N3 `( q1 C& Q1.
   原來CLK要一樣或者有同步
% g# |6 x! h+ t5 n. Q0 t" v2.
   "at TCL maxCLK will not reflected in count value lached.==> TCL 為正值 ,counter 正在變化中,
    Latch值不確定"
  M+ Q7 K7 a) ?3 s, l) x+ A3 o
3 f. m; }' H7 p& {9 E( Q    這點我倒認為他的意思是tcl大於等於max 45ns時會鎖到新值,而不是不確定,不曉得我的想法對不對?

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題外話
* k' l4 @1 Z$ F/ W( B) x
請問為什麼現在我都沒辦法對文章評分呢??

會出現
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訊息

chip123

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