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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題; W/ i- y% }0 x) ~2 T
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
+ w. j. |3 A, P8 t# G( c- X2 b& {4 n2 u) t
然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同
' @6 Q9 z! \+ t9 O0 g
& @: q9 X; m( j. j5 |3 d7 ~8 `請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了
" |  i4 I1 c# ~發現到 應該不是我的LAYOUT問題
. e0 a5 Q$ x% f% p+ n) j* ?應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現% ]9 n  G5 A- ^1 g$ f
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝1 W7 j3 W3 T- R
9 ?/ o& u$ h7 v- m* U6 S
9 h# z! u3 c% Z+ j( N( @- S
煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang
# S- B. G4 i% Y- w8 E: C4 w
  k+ Q/ j* A% `  k, Z8 ~
. ~9 f- n5 n7 ^  a8 G: i- Y0 n    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油: P: B4 y, r8 t
LAYOUT要靠經驗的!!!加油9 V& E2 O: R# w/ p
LAYOUT要靠經驗的!!!加油
4 r& B" `8 ^9 Z" x$ DLAYOUT要靠經驗的!!!加油6 r9 m  S  @+ C) j
LAYOUT要靠經驗的!!!加油
$ @% o) h# i. y. KLAYOUT要靠經驗的!!!加油
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