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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › TSMC 0.35 使用laker問題
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樓主: kai520087
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[問題求助] TSMC 0.35 使用laker問題

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uomuom
25#
發表於 2010-2-1 21:44:34 | 只看該作者
大推~看看也好,一起努力阿,一起加油
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24#
發表於 2010-1-23 16:15:56 | 只看該作者
應該是不錯的資料 推~, _/ p. N6 w4 Y: p% _8 ?
正好需要此資料
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a4616871
23#
發表於 2010-1-22 11:28:15 | 只看該作者
我想要看看CIC的講義,我也是初學
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22#
發表於 2010-1-22 10:25:57 | 只看該作者
一 直以來都在做元件分析工作. 該是進階來接觸電路設計和layout. 謝謝分享!
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agou
21#
發表於 2010-1-18 23:58:19 | 只看該作者
非常感謝您的分享!!- l  h$ _- j( e6 O: ~( D8 }
對於新手很實用~
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aleck
20#
發表於 2009-10-15 23:20:36 | 只看該作者
這魔好的資料~~當然要支持一下啦 4 R" ?  ?; M! |4 G3 c0 U, d* G  ^
~~~感恩啊
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pkch15
19#
發表於 2009-10-12 17:42:15 | 只看該作者
GOODGOODGOODGOODGOODGOODGOOD
! T( w3 I' T( ~% _/ {9 d+ v有用的資料~感謝大大的分享^^好貼阿~
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linch
18#
發表於 2009-10-9 21:32:43 | 只看該作者
非常好的技術資料, 我也想看看!!!
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17#
發表於 2009-10-5 01:30:58 | 只看該作者
GOGOGO GOGOGO 有學習才有進步 大大我也要學習
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gp3lucky
16#
發表於 2009-10-4 19:59:14 | 只看該作者
非常好的技術資料~~~  d! m7 r* ~  j1 T" x. n; E1 L# h( m% M4 d+ W5 y
  ]9 @/ ~6 x) E9 p正好需要此類資料
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aimyself
15#
發表於 2009-9-26 10:27:05 | 只看該作者

跟着学习一下

非常好的技術資料~~~  d! m7 r* ~  j1 T" x. n
: P4 {1 T7 Y4 F4 x1 k! V  R0 R4 E0 H正好需要此類資料
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limit
14#
發表於 2009-9-26 10:20:21 | 只看該作者
這篇好實用阿！- T8 }1 `" X* S. d
要學layout 的都要看一下吧∼
7 R( y/ ?! H! ]! o好帖推！
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water100
13#
發表於 2009-9-23 21:20:25 | 只看該作者
(5)保護環Guard ring的功用,一定要繪製嗎?每畫一個電晶體就要圍一圈?還是畫好一區塊在圍就好( `. I  x9 E- D2 ^0 D8 k
  看你需求 通常noisy 或是很重要的類比block都會加, b$ E; ]3 e1 ^9 Y# a$ b8 m
$ C: c# a8 C4 P- Z& B" O
(6)電晶體的body腳在Laker上是哪邊還是說就跟Source腳接在一起了?* J, A7 p# C5 ]" F1 Z
  跟其中一邊接在一起就好了
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12#
發表於 2009-9-23 15:16:05 | 只看該作者
非常好的技術資料~~~
, }6 s$ }! y* r正好需要此類資料
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11#
發表於 2009-9-10 13:41:37 | 只看該作者
我也有類似的困擾阿
& E" r$ d2 y, \+ ]  @謝謝各位大大的分享囉4 A  P# F+ d, P; a8 \
一起努力學習了
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axcvb
10#
發表於 2009-9-8 20:17:27 | 只看該作者
有貼CIC關於MEMS或的Analog的教學文件嗎?) i# b2 Q, r) w4 `
，但也想多瞭解一下不同的工具說，感謝分享！
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9#
發表於 2009-8-11 10:02:49 | 只看該作者
同一樓上大大所說的 NETLIST裡面需要有TOP CELL NAME   這樣才可以跟你的 驗證LVS的TOP CELL NAME 相對應喔( }+ N4 B% y- t+ |% i  A
; D9 g; t) P% O) \8 t
不然他不知道要跟誰對應比對
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8#
發表於 2009-8-11 05:45:01 | 只看該作者

回復 8# 的帖子

你的netlist 沒有top cell name    h" C' G, O% d% C
如果你的top cell name 是 OPA
0 Z$ h! i3 @- _; a0 x那你的netlist應該是 :9 e3 W2 H' Y: g, l$ z9 K
.SUBCKT OPA
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7#
 樓主| 發表於 2009-8-9 01:49:31 | 只看該作者
感謝您的回覆,我最後打算使用MOS電容了,剛好可以減少面積,不過電路在LAKER上還沒完成剩下一些小部分,試著跑DRC
6 q8 S; y9 E$ T( P9 x' x( W2 A/ RDRC跑通過了,不過現在爆出了一個很大的問題我想試著跑LVS/ G; C# n# v% m, _3 {9 d  K
可是在按run LVS時總會顯示"source primary cell not found in source database"! d9 y  J  b' I+ @6 b0 `
似乎是錯在input時的Netlist的Files:這項. B4 q1 M( e3 y, t3 f: j5 q6 Y
我附上了我的SP檔,檔名OPA是跑模擬時用的,OPA1是打算做來跑LVS用的(應該是有錯)
$ w. B. C$ A" E% h" a+ c0 ]3 T能在懇請各位高手幫我解答嗎?

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shangyi
6#
發表於 2009-8-8 13:58:18 | 只看該作者
檔案過大 補附件
& D- z0 u0 D4 r, m7 w, e4 L' ^& y2 C4 U8 w6 f
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( u) \1 |9 ^/ S5 Z: T5 P) k8 c
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