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各位前輩大家好，小弟最近在研究D Flip-flop 的比較0 Z6 B) b" d) G+ n
& K+ X: b; X3 ^9 {
環境設定: a.90nm process. j! [. b) f/ z4 s4 i! m0 @1 K
b.clk = 1Ghz/ I ^$ B! I2 i0 N% r- y
c.hspice model: ]# C9 I3 g5 q- } H
d.接成除二電路" d- p4 g; C( j1 b- T% `# Q) Y
+ i! u- }! D$ Y$ F# I$ x% H想請問幾點問題
" W/ Q ]# ]! V6 w
4 b* K( ~% ?1 E% ^1.兩架構測出來的動態power，為什麼TSPC會比一般DFF小(clk=1Ghz)+ L( [ W* q c( Z6 D% I
: f* \8 R! ?7 e: ^. ^! x# ^0 ]- q
理論上來講,TSPC為動態邏輯，動態POWER應該會大很多才是8 y0 q( n* R- }! r. w7 v
1 @( ?' L( D4 }1 g 把tspc DFF 拉高(3Ghz) 才會大於一般DFF的動態power (1Ghz)
; v* _; C- D& |% b) p! d8 T
4 `4 o0 J, l& M O7 G% r2.TSPC還有甚麼缺點？(動態power大很多)0 N, o S4 `; ^& p5 C
, W p- L$ _& F6 J$ X1 D
優點是速度快、delay小、只需一個clock、電晶體數量少（面積小？）
) N/ B1 T a8 c7 v
' s: \" e, I1 s! M e; d 、靜態power小
/ m, s1 T; }. K
* \: t6 B5 t9 e3.既然速度快，power可以藉由電晶體擺法改善，3 t7 m, F* q: f, @, s- g) \
1 }% q6 ^3 c* @# f3 @4 H為什麼到目前為止沒有Standard cell 可以使用呢?1 P# d( c: Y' ]1 M! j5 Q* ?
3 e' A5 | B' w0 t p
! m, V" Q: v1 u感謝大家回答!! |
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狗仔卡
發表於 2013-6-11 10:29:56
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