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樓主: jauylmz
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在Layout時最花時間的工作是....

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21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩,因為一個好的 floor plan 除了能讓訊號線走的順之外,也可以節省面積) u. [) J! C8 A: e4 p* c
2.接下來我覺得比較重要的是 power and ground line 的跑線,因為要走的順才是最重要的,而且若POWER途中一直換線其實也會降低它的電流2 ~$ x' N4 }: j/ ?! v
3.接下來我覺得都還好,因為 DRC LVS block 刻好就會 RUN 了 ,另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話!面積會變大∼甚至拉線會亂七八糟ㄉ∼
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23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠3 o, D, x6 K+ @
你勉強把東西 塞進去之後  好不容易做完
7 h! F5 J5 i2 D% ^7 {& K4 y, i結果電路圖又變了  你就完了
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24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
; y: n& l- }0 B  ^  w5 V一直改圖對LAYOUT來說是最花時間的7 p: f* G2 l. ?" t. I# H+ X7 H
或者是 沒有看清楚 RD寫的NOTE
+ U8 d" \3 I) o導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的# z2 W8 X! G: g

: H) N% J% K8 Y有時候我們公司RD也不想讓LAYOUT一直改
% a9 u3 [0 U2 c" v3 m只是因為有時專案太趕  g8 H* k! H* c, Y4 F2 a
所以只好跟LAYOUT同時平行做9 C( u1 O5 e9 Y" f4 U! c: k  \% e
這樣就容易電路常常會大翻盤
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25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~
+ m1 M5 h. c4 Y光是排列就會影響後續走線' ~$ y! U2 ~& t6 y' X0 N) I+ A
所以要特別注意~~~
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26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
8 h7 m' i4 U( [( ^3 X% K- l最辛苦的就是改圖~原本己經畫好的,但是rd突然說要改圖
$ a. L! Y: w" s: z) y; f3 L然後整個的大小不變,但是改的地方,又比原來的大一些
9 m: F1 E/ Q! q8 j3 ?+ a這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好,所以floorplan是很重要。
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28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非( n8 B& L! L. f" l+ q. e0 ]5 K, x
3 e2 ^" D6 \( j9 m7 P- ]
我花最多時間的是在思考,: ~1 O" u: W  I$ W4 a5 V
一個5天該完成的案子,我可能會花去2~3天思考
; H8 h3 f# l1 f  e/ U  l6 N事前想的仔細,, j7 J+ g* u0 V6 S7 P
開始動手layout一直到驗證完成都會很快而且順利。
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31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难,最能体现实力!。。。。。。。。。。。。。。。
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33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間,可能是因為剛接觸Layout沒多久,經驗不足顯得更無力!
7 e' \4 T% ]$ Y2 Q: V, g. l整合這部份,如果是自己獨立一人完成,雖然時間耗費較多,但是就跟寫程式一樣,如何去安排自己的line能走得順
0 p0 A8 e4 q( P4 O/ S8 c' ]" U我想這才是最重要的!重點一句:還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎: q7 ~1 D3 I6 g' ?/ A
LAYOUT我覺得每項都很花時間0 I7 A2 G. p5 _0 `  S, d! q. o
不管是佈局還是LVS/DRC
2 b$ Y7 u5 Y! w# E每項都得小心翼翼7 G; v0 ^  f4 b8 V
做快不見得好
9 Q% t( d' z# g8 \1 i& F/ e做對才是重要
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35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~7 e+ v/ U# O8 K% g7 e6 r
因要如何將每個block充分擺到適當的位子~
( @1 F+ f: a5 V7 d1 l6 W這是一種學問~
7 W" G1 V) ~" ?' z8 A因擺的好的話~
; `- b$ @% c" P( }" q# F其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   ' e, }8 N! w- V
6.  整合 Chip Integration6 R$ d* K* [( B; T, P* B. j
7.  溝通 communication
! _  A/ b+ P# L5 \這三個最麻煩
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37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧
6 U$ ^+ R/ B- t9 b4 b) w4 o( B$ v
' {1 W8 |# C) `9 Q! t6 d9 p/ @在layout初期就要花很多時間先想好如何排列
5 t( i* ^. n0 V5 P, D6 |, R+ `' l: q4 ^; x  `
想好後,反而才會省下大量的時間
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38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...$ L  h! X9 ~/ x2 y2 U" E
要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   * `, o& Y; d" @1 V, N& K+ s

: o+ Z) l: f: b9 W. q% ?9 h" d' T其他就會很快   相對LVS 問題也比較好除錯
* N' Q" H% V% p$ }" b. r$ c# `2 \' c
HR.概念有  應該DRC LVS比較不會有問題吧
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40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,2 _, F) \' _" l& u+ l% |
再整合時也會是另一個問題
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