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因為 SystemC 可以囊括 high level abstraction 從 behavior -> transaction -> RTL, 所以學習 SystemC 可以從目的來分類:9 \/ u) b, K7 Q7 l
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如果你想做的是 RTL/testbench writig.
8 K* Z0 D* g. z/ Y* ?" C2 f& V底下這一本提供一組 SystemC 在語法上的 subset, 可以說是把 SystemC 當做 Verilog 來用:
/ v# W' U7 `& i% K3 { E"A SystemC Primer," by J. Bhasker
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如果你想做的是 modeling/TLM.2 K1 j* c: t/ q; q1 L, n
這邊難的地方在於會用到大量 C++ 的 class, template, 以及 object oriented 的觀念, 強烈建議要對 C++ 的 OOP 有點觀念:3 Y) i9 q8 e7 T4 y# V' C
"SystemC: From The Ground Up," by David C. Black and Jack Donovan
" U( | F$ _2 D/ Q( Q"System Design with SystemC," by Thorsten Grotker, Stan Liao, Grant Martin, Stuart Swan( [; \) ^8 K% [2 |1 P
" m- M5 L& z5 f: A- p一般 research.! A- a4 H* c. k
包含較多觀念, platform, simulator kernel, simulation speed, verification 的探討:/ f# o- O; F8 t, `- q
"Systemc: Methodologies and Applications," by Wolfgang Muller, Wolfgang Rosenstiel, Jurgen Ruf
5 W4 j8 w( Z; y9 W% P"Transaction-Level Modeling with SystemC: TLM Concepts and Applications for Embedded Systems," by Frank Ghenassia
9 L. @9 V# z, z6 G9 P9 ^8 p' @* y9 T; e/ o3 _7 W( ^
SystemC 相關的 spec.
# Z$ E6 n) O( Q& q1 Y如果要 implement hierarchical channel, 光靠 "SystemC: From The Ground Up" 我想可能不夠, IEEE 1666 SystemC LRM 可能可以協助更了解每個所用到的 class, 以及各個 class 間的 relationship. TLM-2.0 目前有 OCP-IP 和 Greenbus 已經採用 (commercial tool 的 bus model 可能也有用). SCV 我個人尚未成功 compile, 可能麻煩其它先進補充 :
! R% I4 G" `0 ?# t JIEEE 1666-2005 Standard SystemC Language Reference Manual (LRM): D5 I$ {# Y4 `* o( K% i! H
OSCI TLM-2.0 USER MANUAL
e) u: Y, [9 JSystemC Verification Library (SCV)
?$ @ K- }' r- ~9 A Z# q上面三個都可以由這個網址下載: http://www.systemc.org/downloads/standards/ |
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