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[問題求助] CIC類比IC競賽決賽-電路除錯求救

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1#
發表於 2020-7-16 15:46:19 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
今年參加CIC競賽決賽遇到一些問題,想請教專家意見。/ D0 u$ O4 l6 w1 P0 t9 O0 I
            
0 R" X4 i' Y( l9 f, R( v這是今年決賽的電路圖,為6bit log DAC,使用0.35um製成,工作電壓3.3v。/ n$ j. X# n: C8 ^* g; q5 z
初始時會對63C充電至2v,再利用C減少63C儲存的電荷,最後用Buffer輸出。9 G+ C( t& m. a+ r7 V# ]5 J! Y6 R% @8 E

( L! c$ c0 I2 K$ b7 V
9 m# ^) P+ Y( v6 ^3 P
              8 }( p3 ~" ]/ C5 s+ l  Q5 y
這是時序圖,CLKb為CLK的反相訊號。6 H, s/ r% o  t! q
參數規格要求DNL<0.5 LSB,在比賽時確認有達到標準,但成績公布時DNL參數卻大於0.5 LSB。
' o( ?( e% k! g  r# ~以下是成績複查的結果; y* r" Y6 ~1 M1 _1 a; t- w
         6 x* C: V0 D6 q4 I' k
在63個DNL數值中,前62個都正常,但為什麼在最後一點突然超標,
& Z' S' y, I: I" @' @; _實在想不出哪裡出錯,拜託各位專家高手替我找出問題。

5 u! [* o: q  `( Q* Q. a% _; k* M: {- i6 f
5 i" T: ~# ~) m( a

+ B5 \9 v2 }  r. a! E8 v: x

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2#
發表於 2020-8-6 09:46:21 | 只看該作者
如果確認63C及C charge sharing的結果都符合預期$ e$ [' r: ]8 |: M
可以看看Output buffer的input range足夠嗎?
3#
發表於 2022-3-2 13:34:14 | 只看該作者
想請問樓主是比full custom的嗎
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