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樓主: jauylmz
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在Layout時最花時間的工作是....

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21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩,因為一個好的 floor plan 除了能讓訊號線走的順之外,也可以節省面積# x! {* E: h4 J1 D3 f5 U1 x
2.接下來我覺得比較重要的是 power and ground line 的跑線,因為要走的順才是最重要的,而且若POWER途中一直換線其實也會降低它的電流* l; A- O: B  i% W! H; G9 L
3.接下來我覺得都還好,因為 DRC LVS block 刻好就會 RUN 了 ,另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話!面積會變大∼甚至拉線會亂七八糟ㄉ∼
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23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠# w5 T8 a) Q  P) N
你勉強把東西 塞進去之後  好不容易做完
7 H" E& n4 _0 p% f0 h  @: w* u1 G結果電路圖又變了  你就完了
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24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
9 \1 x  ^8 v) g7 j* ?一直改圖對LAYOUT來說是最花時間的: }5 b2 b' s# ?- G
或者是 沒有看清楚 RD寫的NOTE
! r# C8 ], ^* J2 }: N9 s* [: ]導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的
7 C6 x4 x  c8 c9 {2 Q6 r" S- u1 c
  K+ `3 N( H$ r有時候我們公司RD也不想讓LAYOUT一直改
4 C) I- X# R0 D( w( h9 T$ K% d: Y+ k只是因為有時專案太趕
) C6 i0 V# ~7 ?8 J- B所以只好跟LAYOUT同時平行做  r& j3 t- u: T; |
這樣就容易電路常常會大翻盤
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25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~
2 u4 j) O# s# z8 `) |$ g5 ^5 K  a光是排列就會影響後續走線( o3 O; H1 P  U& q4 @, [
所以要特別注意~~~
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26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
; H' ~, C; W( k& t最辛苦的就是改圖~原本己經畫好的,但是rd突然說要改圖
9 L  ?$ g4 M7 Y3 E7 E. ^% f/ o然後整個的大小不變,但是改的地方,又比原來的大一些
* ^: P; K2 z, ]7 V; ]這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好,所以floorplan是很重要。
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28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
9 A4 V3 b" ]' o% ~6 ~1 h
/ r, X; _6 B4 g, O" h我花最多時間的是在思考,
6 B; K6 p' D' c9 J一個5天該完成的案子,我可能會花去2~3天思考4 I9 A5 N; N& v0 G# Z& Y9 m
事前想的仔細,
$ Y5 a3 `% [5 W0 k開始動手layout一直到驗證完成都會很快而且順利。
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31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难,最能体现实力!。。。。。。。。。。。。。。。
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33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間,可能是因為剛接觸Layout沒多久,經驗不足顯得更無力!1 `- e2 }: E: K- ]! k0 R
整合這部份,如果是自己獨立一人完成,雖然時間耗費較多,但是就跟寫程式一樣,如何去安排自己的line能走得順/ i+ g8 p+ f$ T) o; [5 G3 d
我想這才是最重要的!重點一句:還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎5 |- K) K3 P& B- w
LAYOUT我覺得每項都很花時間
6 w( F  O% l* E$ N4 X不管是佈局還是LVS/DRC  c$ \8 o0 m8 Q; f2 L. m
每項都得小心翼翼1 ]3 s, J) t3 T+ `  Z3 n
做快不見得好
) S5 z! @, X8 j* r3 h做對才是重要
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35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~
+ Q7 W/ [4 s+ z因要如何將每個block充分擺到適當的位子~
0 v! d) g; o4 W+ ^% {7 {8 i2 U; C這是一種學問~0 h1 N% l, M- h9 v
因擺的好的話~
) ?; k: p5 U$ L7 a& `其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   - |5 v7 v1 b/ W% ^% z
6.  整合 Chip Integration" w+ j/ K( a3 d4 `
7.  溝通 communication; {  p8 ~" Z- @" q' e
這三個最麻煩
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37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧3 S$ B* @. A: v; b6 a! }& `8 F
6 z; D" H( R+ d+ V# T* s
在layout初期就要花很多時間先想好如何排列+ Y! w: V5 |& ^& `

" d: [9 E2 ]4 R想好後,反而才會省下大量的時間
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38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...& O1 j- x. W/ F  J. ~% g
要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   
7 O& S/ n4 Q/ M+ T+ f1 B5 z0 q& ]5 Z
4 e6 a; N) M6 x( G+ R$ L其他就會很快   相對LVS 問題也比較好除錯
% k: V7 k1 ^+ @1 q; N' h$ f; ^" A, y" J( g7 Z' v
HR.概念有  應該DRC LVS比較不會有問題吧
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40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
. N& P& O1 O8 Y. N& _5 P. J  e再整合時也會是另一個問題
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