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[問題求助] 請問該如何關閉Design Vision的電路簡化功能?

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1#
發表於 2010-4-14 23:09:23 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
不好意思,小弟不知道那個功能的名稱叫做什麼,所以只好很愚魯的描述我想要達成的目標.% @, N5 E5 Q# m

1 ~9 ], E7 Y' E: m5 V  j' P我現在要比較兩個架構大致相同,僅有一部分做了修改的算術邏輯電路,想了解修改前與修改後area與delay改善的幅度
- _7 R0 S: O- p, X但是Design Vision卻將兩者的邏輯電路都做了不同程度的簡化,使得修改後的架構與原先的架構並無太大差別
2 k5 M7 L- W$ C
3 z* d' Q/ |" N- B8 f5 w5 S我很想知道若不經Design Vision的簡化,實際比較起來會是怎樣的結果
1 J( A) F1 q5 |. o# N7 Y- \! B當然,多學會ㄧ招Design Vision的設定也是目的之一.
5 ]: h* W1 L$ ~) I& s6 {# @1 i2 b9 I9 k$ e5 o  D
如果各位前賢能慷慨解囊,多授與一些實用的設定,小弟更是感激萬分.
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