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[問題求助] DLL前模擬的jitter

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1#
發表於 2012-7-17 20:52:47 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位高手好~~" g4 E4 S3 r" c( g7 |; p/ M4 Q

: }, @4 e. s2 h) @我用Hspice要在前模擬做一個jitter小於10p的DLL
+ }' Q$ g6 U  E; p; J" A
: m' K, X/ S; H5 v' u" L; n8 y這是我用來測jitter的語法) j' Q. c+ `" _8 Z" D0 x; v$ t
.PARAM per='週期'         
8 P, i9 A% |# [.PARAM tim='開始時間'0 Q4 z3 ]5 }/ H3 O
.probe tran eyetime=par('.5*(sgn(TIME-tim)+abs(sgn(TIME-tim)))*(TIME-tim-per*int((TIME-tim)/per))')
- T2 W2 U; i* ^0 Q$ `4 O. v
- J; |/ D% K# v" k0 Q整個DLL測出來的peak to peak jitter是25ps
; d  }9 S% B3 h+ f$ ~; K1 T# |/ \# g1 @% Z: t
我一直改Phase Detector、Charge Pump的特性但整個jitter都無法改善
/ {: ?: ~; }0 B) p, f/ q3 l1 c- Z/ ]% \2 @! v% l
後來我用上面的語法去測VCDL這個區塊的jitter,出來的值居然也到2Xps* s8 B- ]+ x. S% Q2 x
% {+ o# m1 |- \5 U
也就是說在VCDL的控制電壓是定值的情況下還是有很大的jitter8 Y$ Z" T5 R# t6 t

6 r- O& I. a$ y( |  @我想問這樣子VCDL可能是哪邊出問題呢?  還有我量jitter的方式有沒有錯?$ m; c/ D9 q/ Y' @
% A$ x8 `  _8 M

$ O  D, m: b! G$ N
6 M! F. [; A  c$ \5 D- [3 h0 x如果還需要什麼資訊的話我會盡快補上的,謝謝大家>"<

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2#
發表於 2012-7-23 06:54:15 | 只看該作者
你DLL的操作範圍為多少?
) R1 h  B/ A6 B* ]你每一級的delay cell的delay time又為多少?
5 Y; v; \6 k- }4 u6 ?你的DLL的delay cell共用了幾級?
1 q/ C, I' r, C( K有了這三個資訊之後,再去測試一下你的delay cell在可以工作的電壓範圍內相對應的delay time各為多少之後?
4 L# ^* N8 _# W8 w就可以稍微推斷出delay cell可以在多少的delay time下工作,亦即可以推算出jitter大概會落在那個區間
3#
發表於 2012-7-26 12:18:28 | 只看該作者
spice的语法不是很熟。不过如果按照你说的,给个固定控制电压vcdl也有很大的jitter,那就得考虑1.是不是测量语法有问题,这个可以通过手工在波形上测量对比一下。2.仿真精度有问题。这个可以考虑调整一下仿真精度。
4#
發表於 2021-12-21 16:41:57 | 只看該作者
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