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標題:
三階DT sigma-delta積分器輸出波形飽和的原因?
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作者:
wlyi0928
時間:
2008-1-10 02:43 PM
標題:
三階DT sigma-delta積分器輸出波形飽和的原因?
各位先進大家午安:
q6 s5 Y: i6 `3 {; B Q
- q8 }5 A5 @" V. X+ O9 ~
目前小的正在做一個三階Switched-Capacitor Single-Bit Sigma-Delta Modulator.
9 w" c& U+ |8 f6 w1 y3 H
應用於音頻, 輸入訊號頻寬=20 kHz, 用的是CIFB架構.
5 | d y$ L( r7 o# b0 U: j& L
很不幸的, 其中第二階及第三階輸出波形皆已經飽和, 量化器輸出的數位值當然不對.
' X, d6 _9 c* E0 a$ [
能否請各位先進指點任何有可能發生問題的地方呢...任何地方都好...拜託拜託...
/ V+ q- u7 l) s) {7 W' r
8 Q! W4 m, ~: `& b) G
感激不盡!!
作者:
baoer
時間:
2008-1-15 04:44 PM
我之前也問過中正大學的李順裕老師，老師說，
6 E' L3 d" {* y3 W0 |# K, S& O( K0 [
你可能一開始模擬沒overdrive voltage考慮進去，
; j7 e8 ~% ^0 L* v9 Y: C( R
那你可以試著去調小積分器前面的系數，但提是
! B/ k9 q, c+ B
改變系數要依舊符合你的要求！
作者:
chip123
時間:
2008-1-17 12:55 PM
標題:
讓好問題得到好答案！
還有沒有更好的答案？看來可能是重賞金額還不夠?! 所以，雖然有這麼多人看過...
, U1 z: O8 h* h' A5 F, v# v
5 X% }. m& H! f0 }5 o0 z. _1 E7 @5 B
因此，特別加碼10元RDB！懸賞者 加10元RDB 以資鼓勵：讓好問題得到好答案！:o
作者:
chungming
時間:
2008-2-26 08:40 AM
系統方面要注意是否穩定，有用MATLAB先跑過穩定度嗎?
# S& c6 p b& X3 L; w
積分器的參數是不是太大，這和樓上的大大說的是同樣意思。
7 ~& Q1 b0 I- p! y3 p3 Z$ l) V" D
電路方面有可能是積分器的commom mode input不夠寬也會造成。
" N9 n1 B" p9 L& k
2 c& {+ c7 c3 V4 b1 ]9 z8 A
參考這篇paper:
9 O" Y9 ^- H5 [
A 1-V 140uW 88-dB Audio Sigma-Delta Modulator in 90-nm CMOS
( R8 A8 X4 x9 I2 U( C/ R, v+ l8 ~/ u
: Z. p* i% c2 G& C- r( G
Libin Yao; Steyaert, M.S.J.; Sansen, W.;
$ F0 g+ Y3 u$ H( I8 i! X
Solid-State Circuits, IEEE Journal of
7 |" R: S/ u' i! ~
Volume 39, Issue 11, Nov. 2004 Page(s):1809 - 1818
作者:
liangshangquan
時間:
2008-4-11 04:32 PM
可以先嘗試用較小的輸入來仿真看是否是積分器超過了op輸出擺幅的原因
( Z5 {: |! L9 U# e u
也可以在matlab�來模擬各級輸出範圍的大小
/ y; d1 K9 e6 O) {1 K Q4 A7 r. @* i# F
如果過大超出了op設計的極限 需要考慮增加增益衰減因子修改係數
7 g: X5 B9 Y. G D! X3 Y
或者在電路中修改結構和bias來調整輸出擺幅
作者:
kuohsi
時間:
2009-3-31 09:38 AM
1. 係數不對，要用MATLAB跑出係數
! S! E: K4 G, S: ^
2. 輸入信號Vin > 參考電壓Vref
4 J2 M2 P8 t" g6 f
3. 積分器極性接反
作者:
glavine
時間:
2009-3-31 01:26 PM
係數可能出問題吧∼∼∼
0 H8 z% q1 Y$ b5 k+ N. ^/ {
AHDL先跑看看阿 用理想的比較器 op dac先跑出來
. k2 k$ t6 x, {
在一個一個換成真實的比較好找bug吧
" {1 z" I8 ~9 j, c3 x( C, \% g
" E6 |% d! w8 [4 f; d% o
也有可能是接成正迴授＝ ＝
?3 P. k$ N5 @& C6 V; L- }' v
這常常遇到
5 _' o: o* C1 T" V- {# O+ Q; G7 }
CIFB的dac也要注意極性 也不能接成正迴授
作者:
qw101
時間:
2009-4-9 04:43 PM
請問ㄧ下，輸入信號Vin(p-p)跟參考電壓(Vref+-Vref-)的關係為何(有倍數關係嗎)，還有如何判斷極性正確，亦即輸入接到積分器，積分器接到比較器，比較器準位再回到積分器(簡單結構，複雜的結構也可以討論)，and如何在時域就大概可以判斷數值是ok的，然後再去做FFT。
作者:
小緯仔
時間:
2009-4-10 01:27 PM
你可能要先用matlab去做系統上的模擬
5 ~' A Q7 F( n# h+ \! `+ n) k/ x
看看是否穩定，係數我覺得是造成你飽和的原因
作者:
bigben
時間:
2009-4-15 12:58 PM
调制器的系数的问题吧？
$ m. g) E5 j2 T* S( V0 b8 j
各级采样电容可以降低看看！！！！！！！！！！
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