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標題:
請問目前業界與學界對於SystemC和SystemVerilog的應用與發展
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作者:
michael6172
時間:
2012-4-20 02:45 PM
標題:
請問目前業界與學界對於SystemC和SystemVerilog的應用與發展
各位學界或業界的先進：
' ~8 o5 L& E$ n' M$ x
1 p' Q7 X% n! a; {+ p0 v/ J
想請問一下，目前SystemC和SystemVerilog的應用與發展，謝謝各位的指教。
作者:
masonchung
時間:
2012-5-9 09:25 AM
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程
* K0 v0 {' {; U. ^, I
SYSTEMC擅長前段
# D! f1 J g* G; x2 Y* S( w2 k. @1 N) r
StstemVerilog則後段功力相當了得
4 o8 Y6 u1 w1 c$ o) F, p. M
可惜這兩種標準還無法做有效率的整合
- o7 S. |1 n5 H+ i$ O7 ^
學界已經有很好的整合經驗
6 w# Q6 f% `9 c2 s8 `( L! B
但是業界中小型還在探索階段或根本沒有
/ ^4 Y( G" m7 s- L4 \& N
大型的Design House & Design service company有專門的部門在研究
/ `9 T G* a! l$ A' Q6 q: `7 B, n
但只是部分導入在複雜的SOC上
0 P6 Z( ~/ Y: A% g: d
總之 越複雜大型的SOC 這種投資就相對顯得重要..
作者:
songw76
時間:
2013-9-4 05:03 PM
systemverilog接触多些，systemC现在看到少了
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