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[問題求助] 關於PLL的頻寬

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1#
發表於 2008-10-10 23:19:02 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我看書上說9 u$ h' C# {; {& `  p  I, [
"迴路頻寬太小則迴路反應慢"" n1 Z, s' j! _
我想不透這是啥意思...QQ' f, B3 B6 n( P1 P! Y  i' a- o$ X

- B4 q. Q  |9 G$ b以前學的頻寬應該是定義w3db(high) - w3db(low)' s* K1 ^% q+ b) c9 z0 |( w8 K0 ^
所以直觀就是操作範圍要在頻寬內2 V# ~3 u* E) h4 C6 ~
但最近看了一些書
# ?5 D* y9 c. q3 ^有點搞混
2 C7 R" F# t' ^# j想請問各位頻寬有沒有代表啥物理意思9 X4 ?1 `; P0 L7 Q( i) ]
(ex:追的速度快之類的)& N% @* g$ L) T0 E/ g
感嗯
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2#
發表於 2008-10-11 15:54:00 | 只看該作者

迴路頻寬~~  要看電子學  迴路頻寬~~  要看電子學; t: |9 |/ |4 e! V' `2 L
這樣教你   你才比較懂  你先看看書 我之後再回你
3#
發表於 2009-1-7 23:09:13 | 只看該作者
迴路頻寬小,迴路反應慢  也會造成鎖定時間變慢
+ `: Q" w! W& C; x但此得到的優點是得到較低的phase noise
4#
發表於 2009-1-9 14:57:05 | 只看該作者
對PLL來說,
5 \  |; Q2 y0 T6 ]頻寬大 -> lock快 -> 但是jitter較大* k( V! p9 q4 X' k  o0 a
頻寬小 -> lock慢 -> 但是jitter較小
5#
發表於 2009-1-11 20:47:01 | 只看該作者
感謝樓上的分享!!原來PLL的頻寬有這樣作用,先前我也是不知道呢!!
6#
發表於 2009-2-3 16:02:48 | 只看該作者
所以說這是設計PLL的trade off.8 a8 E$ V. A) J8 c( a
人人都想要jitter小, 但又Lock快的電路.
7#
發表於 2009-6-12 13:39:58 | 只看該作者

這就是PLL的精隨阿!!

讓小弟我來稍作說明一下!!8 @* o+ l9 n4 P4 a2 R$ }
  c2 p& P8 F" g5 \$ }# u
Type2的PLL基本上就是靠PFD將相位差偵測出來,然後藉由charge pump(CP)電流對迴路濾波器(LPF)充放電
3 n$ `- a% f' s: ?, E" @0 o) w
% [! w- \  w6 ^6 x% |6 @所以重點就是..迴路每一次修正的速度就會和CP電流與LPF值有絕對的關係
# t4 ?3 h9 O4 R8 ?9 k$ h0 F1 v, k' a' o+ v" e) e$ n
而LPF值是藉由整體系統穩定度之分析所得來的,因此才會有人探討BW對於系統之影響...* {* M# }9 A- q/ ^

! Z9 H( r, x# D6 ?! M-------------------------------------------------* X# {! \& h2 i4 r$ D

1 J6 i: V0 r" [; P" |用一個推導過後的簡單關係式來看 -> 迴路頻寬和迴路濾波器的電容值成反比(very important)0 O% u: M$ O2 v- v/ B

, ]' \1 U, W8 H1 l1. 設計時若取"大"迴路頻寬,計算出的濾波器電容值較小,在電流量一定的條件下,每一次充放電的位準增加較快;6 ^0 {! ^: r7 N. ]
& ]( ^8 \1 j9 R5 ]8 l
2. 設計時若取"小"迴路頻寬,計算出的濾波器電容值較大,在電流量一定的條件下,每一次充放電的位準增加較慢;& k- D# a8 @7 \0 q( F% ~% |9 o

: Z9 {' a1 X- X' }以簡單數學式來看 : 大BW時為I*小C=大V(一次變化量大) ; 小BW時為I*大C=小V(一次變化量小)
* ]4 m+ ?: R* {* P& o/ C/ i2 m
  I  G* i- ]2 I* b由以上關係式又可得知 : 大BW時修正變化量大,所以很短的時間內迴路就會穩定 ; 反之小BW濾波器值很大的條件下,電菏幫浦對大電容來說其每次只能產生一非常小的控制電壓變化量,所以鎖定時間會拉長" A, y* n: Z; m6 g  k

. m) j: |3 }. R+ s2 ?9 I+ G總結 :
! V# Y. J6 W; f/ x
9 s1 L, M2 J: D* @% }  D大迴路頻寬 -> 較小的FILTER SIZE ; 鎖定時間快 * _% |/ A  u6 T# r
! r% \  v: |- O
小迴路頻寬 -> 較大的FILTER SIZE ; 鎖定時間慢
+ C9 x+ i/ a$ T* \& G1 F
-------------------------------------------------/ u0 U: s3 P+ n% O

% O; x: ]2 Z0 F' {  ?但在抖動方面沒有一定的定論,因為你要看NOISE是從哪裡來
7 d- Y2 k  ?& U5 e# i0 w; }8 |1 Z- u) [+ O, e4 ^: k: b- B* h3 n
1. 一般來說,若當系統的輸入訊號有較大的抖動時,如時脈與資料回復電路的應用,則此時必需選取一個較小的迴路頻寬,因為整迴路可看成為低通濾波器,若你迴路頻寬設定的越小,將可抑制越多輸入的雜訊
# g1 V" {6 q  e$ z- ?0 i& e3 z
, D5 Q$ a3 e* }( O0 `  n: z2. 但是若系統要求一非常穩定的輸出,如頻率合成器的應用,則迴路頻寬就必需設定稍微大一點,因為電壓控制振盪器為一高通的特性,頻寬越大,將可以抑制越多高頻的雜訊。
2 ]+ H! C: Q- O 6 K2 t' R3 ]6 _% S$ n# l% U2 s
因此在設計鎖相迴路或是延遲鎖定迴路時,如何選取迴路頻寬值是沒有一定的答案,
: V( D' F' Z  W; [% Z! U; ~. {) V8 [' v2 b- q3 [! W- P
迴路頻寬和系統的抖動、鎖定速度、迴路濾波器的值..等等都有密切的關聯性,要視應用而定
. ~5 ]8 T5 ~. ~" }; P( U, F! i) Q* C' ]1 E
以上為小弟之淺見,若有問題再一起討論囉!! Good Luck~

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8#
發表於 2009-6-12 16:17:36 | 只看該作者
瓦,很多內容,謝謝各位大大~# E! a3 Z6 A3 q; s9 G
謝謝~對於pll我是一個starter,原來有這麼多的講究和奧秘~
9#
發表於 2009-6-15 11:42:58 | 只看該作者
Very good answer, I've learned a lot
10#
發表於 2009-6-18 23:40:56 | 只看該作者
B大好厲害喔~!!!
8 f& b+ x' y9 F4 d, _7 |. Z& w5 W超感謝B大的講解~!!!6 N0 ]6 j+ B/ S+ T
剛好跟大大有著相同的問題~^^
11#
發表於 2009-6-19 13:14:28 | 只看該作者
謝謝B大的解釋; u0 ]5 r. l; i" I

4 {0 H% x0 q" |1 b. r- S最近也是在想這些問題
9 I7 ^* t2 x1 p& [7 g3 X! n7 l! C1 @3 C; S7 w
但是沒有像七樓大大這樣完整的思考
12#
發表於 2009-6-23 17:08:48 | 只看該作者
谢谢上面的解释7 i+ s6 \" ?( I; ^. T  D, s% j
真的很详细 透彻/ Z2 T4 ~* g# H9 |; S2 Y* _
谢谢了
7 y' g- O; D0 {8 ^  q6 T+ B
13#
發表於 2009-7-13 04:04:05 | 只看該作者
建議你看書中對於PLL 鎖定時間的推導公式。你會發現鎖定時間確實在式子上是跟頻寬反比的。
14#
發表於 2009-7-24 13:37:34 | 只看該作者
感謝大大的解說和提出,最近正朝向這專案邁進。
15#
發表於 2009-11-24 14:50:08 | 只看該作者
Very good answer, I've learned a lot
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