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樓主: 0918429587
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[問題求助] 關於ESD input and output pin 保護電路設計

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21#
發表於 2010-5-10 14:38:41 | 只看該作者
Per my experience ,Diodes + RC-Control , inverter and PowerClamp is better for out pad2 j" z/ s- ~5 H4 I, A/ L
Generally speaking ,the root cause of ESD failed is from below.8 B  f2 M# J# L) U' v2 h" `
<i>clamp NMOS's ability.' y$ e2 d% m* Q5 K  R6 o/ x
<ii>clamp NMOS's turn-on rate.
) N9 s- x6 I) s<iii>Not follow design rule.......................# X2 ~+ r; L; c* G
As we know ,RC-control is to keep clamp NMOS off when IC is on normal operation.(us)  x' a, A; A* ~5 j) d
When sufferred ESD pulse(ns),GGNMOS be turned on by coupling .0 A6 u! N3 F8 T( d, ]3 ?  q
If adding inverter between RC and clamp NMOS,it will speed up clamp NMOS turned on.# r1 T. p0 q1 K/ U7 P: l, i
Just for reference !!!
22#
發表於 2010-5-27 10:56:55 | 只看該作者
謝謝大大的分享~更加了解esd的重要性
23#
發表於 2011-11-2 10:18:02 | 只看該作者
如果在輸出端加CDM,那輸出端的ESD MOS等於白做9 f- n# C( r4 C- l# O5 {8 E% r
$ ]) m6 V' u" L6 b
一般CDM diode size相較ESD MOS size來說小的多  L% F1 U4 a, k+ _/ D. B: |4 v  a$ l
如果同時加上CDM diode,肯定會先死在CDM diode上。
24#
發表於 2011-12-6 08:42:20 | 只看該作者
谢谢诸位的分享,
25#
發表於 2012-1-2 09:45:52 | 只看該作者
回復 20# ihcnqkm 3 Y/ e" f% y/ J3 e( ]

6 Z, n" U3 \0 I/ }3 a2 Y0 W. C1 a$ x) P
    很有用啊 ~谢谢各位的提点
26#
發表於 2012-7-12 12:19:45 | 只看該作者
学习学习!!!!!!
27#
發表於 2012-10-20 15:02:46 | 只看該作者
学习了,谢谢大家啊~~~~~~~~~~~~~~
28#
發表於 2021-8-25 09:57:36 | 只看該作者
感謝大大的分享,受益無窮
& N  [0 B' e0 J. t- @8 V, L4 q
( @& w- E/ y: T! S  T4 a/ \" U! M3 d謝謝
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