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[問題求助] 三階DT sigma-delta積分器輸出波形飽和的原因?

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1#
發表於 2008-2-26 08:40:51 | 顯示全部樓層
系統方面要注意是否穩定,有用MATLAB先跑過穩定度嗎?8 R" Y- ~. R) H. M6 {/ V0 j
積分器的參數是不是太大,這和樓上的大大說的是同樣意思。
0 D3 y" q' H  a6 [電路方面有可能是積分器的commom mode input不夠寬也會造成。
* u5 |- s3 o8 n; F3 w* h9 g% {# W1 B) n$ _9 A
參考這篇paper:2 p- z! {3 I, q1 E( ?
A 1-V 140uW 88-dB Audio Sigma-Delta Modulator in 90-nm CMOS
* Y5 A% \: O8 b5 U/ L' g4 p8 C, z
Libin Yao; Steyaert, M.S.J.; Sansen, W.;# [+ T) l' Q- D; i5 F1 o
Solid-State Circuits, IEEE Journal of! T* Z0 s; \' D
Volume 39,  Issue 11,  Nov. 2004 Page(s):1809 - 1818
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