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[問題求助] 請問大家是否使用過CADENCE公司的CPF低功耗流程呢?

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1#
發表於 2009-10-12 11:11:14 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問大家是否使用過CADENCE公司的CPF低功耗流程呢?如果這個流程的軟體在CIC中可以得到的話,最後tape-off需要付給cadence公司費用嗎?如果有做過的話,請問還有什麽需要注意的嗎?
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2#
發表於 2009-10-12 20:48:55 | 只看該作者
Not "Tape-off", it's called tape out.
% T7 S4 r- V$ w% ?) Y/ a! @: n$ s$ q% W) `; _
CPF is the common power format, means a syntax of a file.9 ^/ H6 {4 ~4 V# i% r) @
It is not a software.) V; h# O+ l: ]. Z& S
No charge ... instead, they will happy that you are using it.
' Y+ X  v, q( _+ ~It's now a SI2 standard, visit SI2 website for detail.
3#
發表於 2009-10-16 09:07:27 | 只看該作者
Well, CPF can be applied into several different stage in the circuit design. Simulation, synthesis, placement & routing and power planning. To my understanding and experience, synthesis with some power saving standard cell, for example, level shifter, stage retention flops, is the most commonly used flow in industry. If you want to start with CPF, see if you can start from low power synthesis(not sure this is the right terms). This is my opinion.
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