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[問題求助] Virtuoso CDL Import設定問題

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1#
發表於 2010-8-4 16:24:45 | 只看該作者 回帖獎勵 |正序瀏覽 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file$ |) a# `* e5 @$ |
請問reference library指的是??% k8 b$ W5 P! S+ }; C
以及可以請教如何撰寫device mapping file嗎??
( ?. w$ w1 s: V( ^. B/ k* m# L" U: V3 J: g& k& r  a
謝謝各位大大囉
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4#
發表於 2012-6-5 09:02:02 | 只看該作者
補充:2 v& c, S$ i* w. ^
1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library.6 w3 K5 d) \4 i( h5 ^
2.  Syntax for Specifying Device Maps in a Device-Map File:+ t( ~( ~/ K5 [+ M- P9 M  X! I4 u
     devMap := <primitive_device_name> <mapped_device_name>
7 j: p8 R! ~, \5 X0 Y) h- E; m     [ propMatch := list_of_prop_to_match ]9 s( q7 c3 ^9 m  B
     [ termMap := list_of_terminals_to_map ]/ t1 `. v+ d% b0 l- @# F& N
     [ propMap := list_of_properties_to_map ]
6 h  `. @4 E: _* L     [ addProp := list_of_additional_properties_to_map ]
0 g% [% s* s7 p      Example:: n4 D/ o+ s: R/ Q4 M8 H3 A
      devMap := resistor res6 e6 K+ E# \3 g
      propMatch := r 20000
! _  N. f& p4 }      termMap := PLUS PLUS MINUS MINUS
. c0 ~  X5 N: m! Z* p3 b  S* G      propMap := subType type r resVal w width l length
8 k3 y. n+ d/ i  ~. b      addProp := model res
3#
發表於 2012-4-12 17:02:34 | 只看該作者
device mapping file4 k; S# R# I  ?& O9 E& D3 W
先vi model.map file
% D- \1 d0 y; |. U* Y- sM PCH  .   .# V2 }9 C" a  q8 W- u0 k  p; W
M NCH  .   .
( n/ N5 H8 s  E. K: y# S第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱,7 P0 t  w: S/ Y3 s
也就是說沒有自建layout 如下:
$ _1 @: j* g! hM PCH  .   PMOS
' C0 m; z. g3 V: {  w5 G! [* N- g3 QM NCH  .   NMOS$ T3 {4 ^- j' V- j7 Y. o
如有自建layout library& v' |1 J* ]; L) p' z% K9 ]6 R
M PCH  lib_name   PMOS3 v$ ]% q& \: y! O. R9 A
M NCH  lib_name   NMOS
2#
發表於 2011-4-29 14:42:45 | 只看該作者
reference library指的是你用的nmos/pmos/inv....etc. library
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