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[問題求助] Virtuoso CDL Import設定問題

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發表於 2010-8-4 16:24:45 | 顯示全部樓層 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file
* ~4 n$ C$ q0 B- {+ ~請問reference library指的是??3 n% c7 ?3 @' B# ?& ?8 U7 d% d
以及可以請教如何撰寫device mapping file嗎??+ z! a; `& p7 k7 I
4 ~8 a2 x! ?1 F
謝謝各位大大囉
發表於 2011-4-29 14:42:45 | 顯示全部樓層
reference library指的是你用的nmos/pmos/inv....etc. library
發表於 2012-4-12 17:02:34 | 顯示全部樓層
device mapping file: F2 F% m- S, `
先vi model.map file
3 K, w$ I& t$ E: h9 N+ sM PCH  .   .
) l" x4 J- }$ H: s4 b; r3 n/ OM NCH  .   .
; Z4 A+ u* _( h' Z* b第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱,
+ Q+ x6 `$ {/ f5 L* u也就是說沒有自建layout 如下:. k4 z- O9 |! z$ x# \4 }% j" D/ D/ Y
M PCH  .   PMOS
! u- E& x5 z) u3 A5 KM NCH  .   NMOS; d4 u* ]8 t$ Z- M6 \
如有自建layout library1 o8 J% e  k* f$ W1 X  X
M PCH  lib_name   PMOS  P( r  T. A9 v: Y* E8 h7 `
M NCH  lib_name   NMOS
發表於 2012-6-5 09:02:02 | 顯示全部樓層
補充:
- i  d/ d8 X8 a+ P- b3 U8 D1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library.
7 v0 z8 E6 s- z- H( r2.  Syntax for Specifying Device Maps in a Device-Map File:
. D1 N9 ~8 u: }) C! \/ a$ X     devMap := <primitive_device_name> <mapped_device_name>( k( d4 G# O# X: g) k
     [ propMatch := list_of_prop_to_match ]
- k5 K. C" e; p6 B% S, r     [ termMap := list_of_terminals_to_map ]
5 ^0 Z" _1 O2 y1 w: h1 K     [ propMap := list_of_properties_to_map ]
: ]' @/ O1 r' Q     [ addProp := list_of_additional_properties_to_map ]
6 [7 s6 ?. w' y- y      Example:
8 K/ x% x( s# M+ Q7 Q  ^8 b      devMap := resistor res& o0 N6 R2 S/ j6 Y( L6 k; E$ ?
      propMatch := r 20000) I* ~1 r+ \8 V2 w+ b' C1 Q
      termMap := PLUS PLUS MINUS MINUS
! S# j  O% \1 m- Y3 c% u9 D      propMap := subType type r resVal w width l length
6 X) ]$ H5 {. X# L, I) M      addProp := model res
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