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[問題求助] Virtuoso CDL Import設定問題

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1#
發表於 2010-8-4 16:24:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
在CDL Import裡設定的reference library及device-mapping file' e# b+ |( @/ b6 a9 c/ p; o5 _
請問reference library指的是??' |5 i8 n5 E6 o
以及可以請教如何撰寫device mapping file嗎??
- P4 V9 K- X4 ?# a" F+ o/ d/ S3 U' E: \5 }& z& v1 a
謝謝各位大大囉
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2#
發表於 2011-4-29 14:42:45 | 只看該作者
reference library指的是你用的nmos/pmos/inv....etc. library
3#
發表於 2012-4-12 17:02:34 | 只看該作者
device mapping file
9 N7 Z4 s7 ^9 P( u% o8 B先vi model.map file8 B( U: T0 F. o3 L( Z" H
M PCH  .   .
2 h( M& m; e; `6 k& `  p0 E7 x6 HM NCH  .   .
' C) j( ]+ T- F) M; y1 ]& g第一個 .  是自建layout library, 第二個  . 是 TF file定義的MOS 名稱,
2 l* e, {; G8 }* T/ ?5 P也就是說沒有自建layout 如下:
% s3 Q8 R3 d5 g8 V5 S. Y7 uM PCH  .   PMOS7 h  [; k/ b& K' ~. n$ Y# Z
M NCH  .   NMOS
. ~- f3 _4 b. Q- L# c% s8 C如有自建layout library
" P9 @0 T4 ?" u/ s9 kM PCH  lib_name   PMOS
- w# b! r4 A* f3 A8 AM NCH  lib_name   NMOS
4#
發表於 2012-6-5 09:02:02 | 只看該作者
補充:2 m& ]1 q3 l; J! D, ^) Q$ c0 W
1. Reference Library: the reference libraries or Process Design Kits (PDK) where the symbol views of master cells are present. 既你想要用的symbol是來至哪個 library.
3 E7 Z1 y& e# a/ t5 I0 [2.  Syntax for Specifying Device Maps in a Device-Map File:) j+ V2 Z1 ]. ?9 {( H
     devMap := <primitive_device_name> <mapped_device_name>/ K4 t& Y) D0 T- v
     [ propMatch := list_of_prop_to_match ]
) z2 ?$ c8 v, s& i     [ termMap := list_of_terminals_to_map ]
; O5 ~9 s, q" C& t; s( \4 l5 p" c5 d     [ propMap := list_of_properties_to_map ]
# H) K. s, U% C. l& o4 }! B8 w0 x     [ addProp := list_of_additional_properties_to_map ]
7 h8 a0 c9 i* `      Example:& c) Y9 J1 C4 x
      devMap := resistor res
1 m$ s" Y4 a  ?5 V- n      propMatch := r 20000: o6 {8 Y) ~. a# F( M  ?: ]( z
      termMap := PLUS PLUS MINUS MINUS3 \* P* ^! C2 J3 i0 F0 L
      propMap := subType type r resVal w width l length' q& B; O" H7 H3 K$ V' A' H
      addProp := model res
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