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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-5-9 09:25:05 | 顯示全部樓層
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程" v; f5 z1 s$ h$ h
SYSTEMC擅長前段   y8 i- \& H6 d/ K; r2 H
StstemVerilog則後段功力相當了得
9 g  {3 Z6 f7 x- s可惜這兩種標準還無法做有效率的整合) a4 R4 S: c& C  I
學界已經有很好的整合經驗, @) B! j( G1 s9 e( _; t
但是業界中小型還在探索階段或根本沒有6 x" G; D6 W0 t0 C
大型的Design House & Design service company有專門的部門在研究 : |1 y9 n* N, I7 v$ A. b/ y9 O
但只是部分導入在複雜的SOC上! \) m2 n2 [: Y+ d
總之 越複雜大型的SOC 這種投資就相對顯得重要..
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