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What Verification IP do you plan to use MOST on your current design?

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發表於 2014-7-17 09:32:17 | 顯示全部樓層
ASIC Verification Engineer (WMAC)
& N, c/ Z# k8 c  }+ D! C3 n
! C) Q0 x  V: {6 p公      司:A famous IC company
4 J3 d) m! r4 l工作地点:上海
+ e7 z8 {$ a4 n7 |$ N# [9 |# w" N: {0 r" T1 a& B6 d# H/ Y
The Role: % i* n5 r. J) F- s5 \  g5 j
        ASIC design and verification * z9 o: }4 i" o6 J, Q; B+ S" R
        Work closely with the California teams
% W+ b/ j# K8 M# B7 G9 g  F        Support chip tape out and bring up : W" @  L+ _  o2 J

( a: t, h/ l% J1 V3 a. ~4 HRequirement: * \8 o$ Q9 h4 G1 _; w- G
        8-10 yrs. experience  : ?0 n3 D$ b1 a
        Knowledge of Verilog / System Verilog & Perl 5 ~" j7 n8 G' I- \
        Has worked on complex project; experience with 802.11 is preferable ; V/ x' A2 s& a5 _9 K2 k
        Can work independently - want him to take over MVE
( B9 v0 E9 ^( g9 s  M/ x        Experience in Networking SOC, Ethernet MAC or any other MAC layer protocol experience is plus
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