brief for Cortex-M0/M3 Logical Validation Implementation

sinoicboy

├─doc
# X# k; @3 {  e' d4 {│  ├─Cortex-M0_TechnicalReferenceManual_Frame
& ~; g( Z9 j+ F$ U' l+ u% Y6 h4 v# z│  │  └─graphics
2 P" T- m# C3 b/ K│  ├─Cortex-M0_UserGuideReferenceMaterial_Frame
│  │  └─graphics
. b$ [$ Y4 E5 |# a, R* h# f│  └─Cortex-M0_UserGuideReferenceMaterial_XML
; _8 A4 l# S. O9 `( P) E- d│      └─graphics
8 X# i2 t! |% @# x( S: h) [├─implementation
│  └─vectors
│      ├─CORTEXM0IMP
│      │  ├─crf
│      │  ├─srpg
│      │  └─tbench
+ c5 j4 i) E: `9 u│      │      └─logs
2 U, z4 w( i& {4 h5 x2 w! M5 z& A% ]│      ├─CORTEXM0INTEGRATIONIMP
7 }3 Z, `" r4 k) q0 b│      │  ├─crf
2 |  ?( J; u; E+ ^+ B. w8 t/ b│      │  ├─srpg
6 \) A( ]) M7 M/ L$ s│      │  └─tbench
) M2 G3 A9 Z9 ~│      │      └─logs
& S7 z- P/ G$ m: ^+ Y2 B! a, w│      └─tools
│          └─VerilogCrf
$ ?+ P" I8 P* d. t% B; c) Y8 K├─integration_kit
│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
│  │  └─tbench
│  │      └─verilog
3 C& y7 ~4 u# w8 ^* F/ x│  └─validation
│      ├─glogs
. g4 r( ~' M" G8 v% @6 n│      ├─logs
) q' e) d. |! h1 m$ F! T/ \* @) I│      ├─mdk
│      ├─srpg
+ Z$ f' V3 U' C, P: A5 C│      ├─tests
+ V* o1 m; L, ]│      │  └─CMSIS
│      │      └─Core
. U4 V9 e8 ]7 U! `# O│      │          ├─CM0
│      │          └─Documentation
7 D! {" k" a- g+ {│      └─vectors
# x: b$ [  n, J, u4 C. ?  C! ?4 y* h├─ipxact
% |- ^- y: h( S" s+ O0 j│  ├─busdefs
$ ]: N4 m* |. i  A' M! B* }/ ]" |% p│  │  ├─amba.com
│  │  │  └─AMBA3
│  │  └─arm.com
│  │      ├─CoreSight
: G; S: V1 {* T. O/ \+ |% |$ H│  │      ├─Cortex-M0
/ f2 p/ o. n2 r  [│  │      └─CortexMCores
, v' t# f; X8 J1 h; ?4 l│  ├─channels
│  │  └─arm.com
7 g  u5 H! n# [/ I│  │      └─Cortex-M0
# P7 j& e) A4 A0 c  ?  q│  │          └─rtl
│  └─components
: T2 M( E7 Q0 F: I7 ~# g8 a│      └─arm.com
9 u" O3 r! _1 ^; ?: n. i& R│          └─Cortex-M0
└─logical
    ├─cortexm0
1 y, l7 [5 C' F, v( g4 u    │  └─verilog
    ├─cortexm0_dap
    │  └─verilog
    ├─cortexm0_integration
    │  └─verilog
    ├─models
2 n% j6 ^" X7 x- _    │  ├─cells
    │  ├─cpf
    │  ├─upf
    │  └─wrappers
    └─ualdis
6 |8 u+ R! }( O& g  }8 m% N2 R        └─verilog

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sinoicboy

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
! ]9 E) `( I8 z) A4 |1 W│          DDI0337G_cortex_m3_r2p0_trm.pdf
0 ^# M7 L- K$ y* Y- j0 ~1 t' [│         
9 F1 B8 s; n3 _0 H$ \# X  }) p6 X- R├─AT420-DC-02008-r2p0-00rel0
) F$ i" k, E3 d) r# q│  └─docs
  V6 g8 M' ~0 ]6 s2 T9 S6 x│          DII0194A_cortex_m3_r2p0_csg.pdf
8 V' k  Z9 [7 z% @2 l  Q│         
├─AT420-DC-13001-r2p0-00rel0
│  └─docs

│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
2 x( }, f% t, k. _9 n# X│  │  │          CM3ROMTable.v
/ y, R+ d) B& E7 @│  │  │          CortexM3Integration.v
│  │  │         
│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
1 i* o5 [$ u3 O' U. g) D4 T│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
" ]8 l" {% j* ?* x( q  [│  │  │          DAPDpClamp0.v
) U, c, B4 k# i" N9 q; S; Y│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
3 @4 g' o# L+ J3 S6 T│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
, o. L2 p/ r" `' _, h│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
" Z. M9 c7 S' |' I& Y│  │  │          DAPSwjDpDefs.v
0 @- f8 \  f/ N+ F/ t5 C, }│  │  │          DAPSwjWatcher.v
│  │  │         
  M! b% A4 Q/ Z/ x9 g& B! F│  │  ├─models
│  │  │  └─cells
│  │  │          CM3ClkGate.v
5 J) s2 Q; D$ L! F│  │  │          CM3EtmClkGate.v
$ C) z3 g: e; ?│  │  │          CM3Sync.v
│  │  │         
$ `0 {. [# a. v1 n│  │  └─tbench
. E9 t8 l# M, \│  │      └─verilog
│  │              AhbToApb.v
( l( ~/ k5 U- x. U2 {9 T1 k│  │              AtbLogger.v
) d* T  j  [2 Q  _7 V- L& G│  │              BusMatrix.v
& Z2 k& {' e$ l! `5 ]│  │              ClkReset.v
│  │              CM3BusComparator.v
: a, [: J, X( ?( H7 R│  │              CM3BusGasket.v
│  │              CM3TestExAcMnAhb.v
│  │              CM3ValAHBSplit.v
; L! B- P) d# I) M1 R8 w% N│  │              CM3ValApbTrickBox.v
6 Q9 X1 O+ k0 t) k6 U3 U  i│  │              CM3ValBusCompareCtrlReg.v
- [( M7 a; T; V2 C5 E, r: [% s! N3 ?│  │              CM3ValControl.v
│  │              CM3ValDebugCore.v
6 G( U1 d2 Q+ k) |6 Q│  │              CM3ValDualPortRAM.v
( ^+ X- R' Z6 T6 ^│  │              CM3ValDualPortWrapper.v
& C; p5 \4 X4 l: R5 i! Q2 M│  │              CM3ValETMTrickBox.v
# z) U- I1 R. g8 L# w9 d8 F) G│  │              CM3ValHTMTrickBox.v
. K4 }% g$ ]2 U% l4 v% s  m" T0 t│  │              CM3ValIRQGenerator1.v
│  │              CM3ValIRQGenerator2.v
│  │              CM3ValJtagTrickBox.v
9 T1 E% v; M% k% ?) p│  │              CM3ValMemory.v
* b* i5 z7 t  D9 U│  │              CM3ValPMU.v
. U: ~# }5 ?, L! j│  │              CM3ValRAM.v
, X' h) D$ t2 M' n6 A! a; x│  │              CM3ValRAMWrapper.v
│  │              CM3ValScratchPad.v
& o$ t2 h- r) M8 J/ P* ]8 D│  │              CM3ValSWCapture.v
│  │              CM3ValTBDefs.v
│  │              CM3ValTraceOutput.v
│  │              CM3ValTraceSync.v

│      │  │  exclude_list.sc_waitstate
& z- D, b/ @! p2 o* P4 i' J# s
, ?3 U& r  u3 q6 z; ?8 p( d            │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
            │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
: z7 w8 f; K) K8 y" q$ z            │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
            │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
0 F3 T' ]9 z, G            │      │  
            │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
1 U* R: p8 ~; ^; a* _1 V            │              cells_1.geo
            │              cells_1.pwr
            │              index.cli
            │              README.TXT
& w: i8 O5 C, z% a, P0 n            │              rulesets
3 F* w4 x6 a" w6 Q: ~6 F% l, C* M            │              VERSION.TXT
9 j& a/ @/ i- X* w: {, T            │              vias_1.geo
$ }% @/ l1 w3 l$ R            │              
9 a- \& p# @- v) L6 k1 c            └─tsmc
                └─t-n90-lo-sp-002-f1_1_6a_20060914
& e% p3 L" e9 J8 r5 p& W5 l' {; j& D3 a                    └─6X2Z
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talrasha

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jm2000

Chip123 科技應用創新平台

jm2000

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cjwei

The Future for the IOT, M0 and M3 will dominate the market.
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yumumu1991

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