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2 b2 M! Z# W1 w+ e
4 A, k" v% k* Y* o( A$ j. ?├─AT420-DA-03001-r2p0-00rel0
) c  ]3 r6 J& X; Q0 x" E8 B│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
├─AT420-DC-02008-r2p0-00rel0
│  └─docs
# L: I- ~9 b5 {9 Q6 G6 m│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
& Z% Q% B# X- Q├─AT420-DC-13001-r2p0-00rel0
4 }: d% L5 Q" J- N* _│  └─docs

& A. t: L' o; i3 g│  │  │          CM3CodeMux.v
9 P3 k% P, M& K( Y5 m; s│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
$ m9 g+ {  n8 l4 U$ C7 h+ e│  │  │         
% M3 D( i# }5 h* U6 N) W  Y│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
0 L- \, k& d0 ^9 t9 H; q0 N6 c) ^│  │  │  │  
│  │  │  └─verilog
& }( r, \5 F2 v1 h1 A8 |│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
7 z- J) ], m/ f5 z3 s! L│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
" M0 X* t8 K$ E- c, h: I% U│  │  │          DAPDpIMux.v
+ B( I. O3 {' M5 ^: z) w1 @│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
# b! a" c# L5 i* H/ B+ a6 y│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
& t+ N( v/ I" N│  │  │          DAPSwDpProtocol.v
& Q; R: O9 H# I4 C( `│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
( L! {2 G0 q  O4 I3 m0 `│  │  │          DAPSwjWatcher.v
│  │  │         
: X* L5 ~; `5 p( |! W& A; M│  │  ├─models
% r+ O1 D1 U+ S  w│  │  │  └─cells
! r) U+ g7 r/ R( u0 l( ^3 E  B│  │  │          CM3ClkGate.v
  s+ h; H8 E/ V. c( G' `; r! F│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
# m$ b7 d; d& D- s6 A1 q! k3 |8 F/ t│  │  │         
% O- I' }5 _! a7 E! u2 \│  │  └─tbench
! }$ C" o. \$ p5 {│  │      └─verilog
│  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
! t4 `) m+ Y* \6 \5 y2 n0 s│  │              ClkReset.v
│  │              CM3BusComparator.v
, T+ Y, p' {. \7 t5 p, k; K
2 m- u% T+ r6 ~
. d8 J! y2 K2 O- F/ _* H4 E; F* R│      │  │  exclude_list.sc_waitstate

: E' T& l: ^2 \4 ^! R/ p5 }             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
- H# q1 W4 e7 m/ D- q% b7 l" z             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
" c$ S( h! M, W" }$ H7 g5 o; u             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
% T4 P2 j8 M# R5 c             │              cells_1.geo
/ H- ]$ c( H1 Y6 y/ @- V9 v/ j7 Y5 G             │              cells_1.pwr
/ G+ p- s( t, L! p             │              index.cli
             │              README.TXT
/ q, k4 N, Q2 r             │              rulesets
9 _, }0 S# Y9 p( s: [2 g             │              VERSION.TXT
" T( w* w0 G* w( u) i             │              vias_1.geo
             │              
$ h- T. b$ z: U             └─tsmc
. t2 S7 ]: z! ]3 ^) L: i. E: \8 P                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
$ q3 Y* X9 r9 y$ O' ?( u2 \8 r5 F                             corner.defs

$ Y# W; q  N! B0 z├─integration_kit
( z. m, U4 q5 M; x$ S, U│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
# k5 q. D& h) D3 c8 x( R2 `. i│  │  └─tbench
5 o) b  R  a! h. ^: g+ n9 P│  │      └─verilog
│  └─validation
: M4 k, v3 d. p0 d! c/ _' E4 Z│      ├─glogs
│      ├─logs
* ~9 f2 _/ B+ `2 b1 h. [│      ├─mdk
│      ├─srpg
│      ├─tests
│      │  └─CMSIS
  P6 ]/ ]  |4 N2 x│      │      └─Core
│      │          ├─CM0
2 M0 i1 m. t8 ^- s4 a│      │          └─Documentation
│      └─vectors
0 B) U' i3 x$ r├─ipxact
│  ├─busdefs
$ l$ O# F: g: I* D! b7 v7 w│  │  ├─amba.com
, h+ j( @9 q4 h│  │  │  └─AMBA3
: [' E  M; ^5 [. d│  │  └─arm.com
│  │      ├─CoreSight
. H) _0 y; H% g/ O- u; H│  │      ├─Cortex-M0
0 Y+ G5 W; a) s( M│  │      └─CortexMCores
│  ├─channels
│  │  └─arm.com
& V) q; N% {+ y0 B9 e& ^' @* k│  │      └─Cortex-M0
│  │          └─rtl
+ V( R5 P- K' `0 X- @" v│  └─components
! h' n2 `$ ?5 n( P: y9 \0 E6 g9 Z│      └─arm.com
: d+ {( W6 n8 r" B2 z/ X│          └─Cortex-M0

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