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* A0 M5 K1 i/ L9 S, k  @* T
3 J! w/ c  x/ i8 N/ d├─AT420-DA-03001-r2p0-00rel0
: g* V/ \9 W3 A# m6 d3 C( v4 \6 F│  └─docs
( }+ \" i: C" l7 H/ W6 b│          DDI0337G_cortex_m3_r2p0_trm.pdf
) d3 P& \1 l1 G5 D* O# [+ L2 N│         
├─AT420-DC-02008-r2p0-00rel0
) T8 y* I  f" U$ E6 M│  └─docs
; f5 j! z$ }2 I; y3 B+ H, C│          DII0194A_cortex_m3_r2p0_csg.pdf
/ ]# J# s+ I/ H│         
├─AT420-DC-13001-r2p0-00rel0
│  └─docs
" q& K; i- k: M. w, W
2 i/ Y+ @2 a0 F5 y* M! ^: g│  │  │          CM3CodeMux.v
, X7 \+ x# V0 ]; E! w) N* q" A│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
4 x6 X  M+ \: E1 |' a│  │  │          CortexM3Integration.v
│  │  │         
2 L0 v8 F" p+ M! r│  │  ├─dapswjdp
1 e& x5 {0 H% S% m: N6 [/ I│  │  │  │  README_DAPSWJDP
│  │  │  │  
│  │  │  └─verilog
# w- U! |  C3 |│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
' b! ]  D5 z4 l8 K│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
" j& n9 ~2 ~7 r│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
' I5 W& U( c: r" E│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
3 Y' ~) y, l7 Q, i( k. S  z! x/ q% \│  │  │          DAPSWJDP.v
; w  ?+ t5 \& s│  │  │          DAPSwjDpDefs.v
( j) }" m& k7 G6 b( U* `│  │  │          DAPSwjWatcher.v
│  │  │         
│  │  ├─models
│  │  │  └─cells
1 `5 ?5 E  ~% y1 Y0 H2 [│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
│  │  │         
│  │  └─tbench
3 a5 A. B/ D. \8 [4 T3 y3 \│  │      └─verilog
│  │              AhbToApb.v
3 a* O/ h7 t6 n9 F3 F" ^! p│  │              AtbLogger.v
5 o: h" @/ Y" F│  │              BusMatrix.v
/ u0 d. Q. N; L, y" \│  │              ClkReset.v
% o' d- |' U( q, H% M│  │              CM3BusComparator.v

4 l: R" x# o5 [- x% c+ I: G% a: ?0 F
│      │  │  exclude_list.sc_waitstate

( u6 {% {" G# [" i, f! P' z             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
  `! F. v4 ^% @+ s, T" `             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
# M; i9 T1 J# B2 A8 I, g* X* Y0 |             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
  K5 \9 h8 G3 d# h             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
2 l" @5 S+ z  U7 M, i+ k1 G             │              cells_1.geo
1 v5 z* T" V% I4 X) }: w             │              cells_1.pwr
             │              index.cli
             │              README.TXT
* P* O: L, }: n% w             │              rulesets
             │              VERSION.TXT
7 p! e3 q- D4 j! b8 N& G             │              vias_1.geo
             │              
             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
                     └─6X2Z
$ A3 A5 F9 e" m4 V, N7 |                             corner.defs
, C5 b! g2 [8 U3 H$ V1 w2 d: X
6 ?7 s+ ?$ K: Z# \9 b' H4 p' [├─integration_kit
│  ├─logical
│  │  ├─cm0ikmcu
│  │  │  └─verilog
. c: |* Z$ _$ n# O; w& C# v, W│  │  └─tbench
│  │      └─verilog
│  └─validation
" y+ b3 X1 N) t9 D- j/ a# ^( h│      ├─glogs
│      ├─logs
/ \) ~! p* Y- f2 D$ I; p$ _1 G8 R- y│      ├─mdk
) U: x$ ~" G. d" K: g│      ├─srpg
! m4 B2 c' c( [) H  K3 J* M% q: {│      ├─tests
│      │  └─CMSIS
│      │      └─Core
│      │          ├─CM0
% s, V! D/ Y; |│      │          └─Documentation
+ z  z/ J0 [1 |│      └─vectors
& l# l! E) f6 g' s  K5 U* ^5 W: s├─ipxact
" U8 ]$ R0 h1 N$ x7 _│  ├─busdefs
5 c4 h( ~: m! Y9 ]+ K+ q│  │  ├─amba.com
│  │  │  └─AMBA3
& l9 ?  Y+ m! B: R+ e" x│  │  └─arm.com
│  │      ├─CoreSight
│  │      ├─Cortex-M0
│  │      └─CortexMCores
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+ k5 x4 I' M0 e$ j: _; j6 u& c│          └─Cortex-M0

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