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iconstart@gmail.com

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
. E8 Q6 J' i0 \& a7 A2 Y0 d/ _  y│         
6 f" z+ R/ t8 Z1 p" Q9 b├─AT420-DC-02008-r2p0-00rel0
│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
' r( J/ c& q" g0 V* p# C├─AT420-DC-13001-r2p0-00rel0
│  └─docs
: |7 B- E! T' {4 s* H' X) q
│  │  │          CM3CodeMux.v
. y* [3 L2 Y8 N' J( e4 q│  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
" A8 P" x; G  i8 x9 S! M4 d0 ~│  │  │          CortexM3Integration.v
; o: P, v; Y# T% S! b│  │  │         
│  │  ├─dapswjdp
' D: m# c9 Q' d│  │  │  │  README_DAPSWJDP
+ M5 A9 d: e+ q, b│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
. t' C& z4 @# [7 S  K2 I& S% w│  │  │          DAPDpApbIfClamp.v
# k7 f$ c9 I5 m5 F5 N4 s# a│  │  │          DAPDpApbSync.v
0 L3 q6 d% I' W) y& R+ n, k2 A│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
, b$ V& S6 R) O$ z* n8 h' o3 Q; `5 w│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
- A4 C% K5 q7 j: U" p. M│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
6 Z% y7 }/ [$ C9 v# C# ?& K│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
│  │  │         
4 u% l' v9 a1 [: O0 [6 q│  │  ├─models
│  │  │  └─cells
│  │  │          CM3ClkGate.v
) A4 }+ Q0 @* t+ ^1 q- F& h│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
│  │  │         
│  │  └─tbench
│  │      └─verilog
) S, w$ L$ s9 I) r6 }│  │              AhbToApb.v
1 `+ s+ X# r" A│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
+ \+ q& V! r/ Y4 O2 J$ F& n│  │              CM3BusComparator.v

4 M( s* W" @3 e/ Y  `% N
) G- _1 K- o+ O& ^& b│      │  │  exclude_list.sc_waitstate
3 u" t* X; y2 W2 F  Q" j
             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
' z2 h/ o2 y0 W/ k             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
0 `/ V$ z& r9 {4 z& Q- z# K             │              cells_1.geo
( L. G% ]+ V7 X# S6 e             │              cells_1.pwr
             │              index.cli
; v6 s5 Y/ w' n             │              README.TXT
             │              rulesets
             │              VERSION.TXT
             │              vias_1.geo
             │              
             └─tsmc
* a! u7 _6 f/ K% W4 h5 E                 └─t-n90-lo-sp-002-f1_1_6a_20060914
* G5 g# n1 W8 H! b! Q" {% D                     └─6X2Z
                             corner.defs
. F+ n' @# m! V6 [2 l8 |, U
├─integration_kit
" H9 K; ]* q7 M8 B$ {: w. C6 D│  ├─logical
& o% U( @/ Y9 k" Y1 {) b│  │  ├─cm0ikmcu
9 s% X3 a" X  x│  │  │  └─verilog
│  │  └─tbench
6 T/ L% ^; [& v  Z- Q│  │      └─verilog
│  └─validation
│      ├─glogs
5 f3 I7 k) ]  ?- `, T7 m│      ├─logs
│      ├─mdk
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: ]' g( m9 i+ N# y│      ├─tests
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│      │          ├─CM0
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# Z5 h( Z- I/ a8 M# }( ^3 d│      └─vectors
6 i5 W) M  M8 y9 z% o9 X' u' q) ^: P├─ipxact
│  ├─busdefs
/ H: e* ?+ P  e. L│  │  ├─amba.com
4 a3 W5 r0 ^& W│  │  │  └─AMBA3
$ l1 Y* ~- w3 Q- L. E, o/ Y  m│  │  └─arm.com
│  │      ├─CoreSight
- O4 I2 J4 j' d│  │      ├─Cortex-M0
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