CIC類比IC競賽決賽-電路除錯求救

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今年參加CIC競賽決賽遇到一些問題，想請教專家意見。
% S2 J. W$ V) v+ W: R& \            
這是今年決賽的電路圖，為6bit log DAC，使用0.35um製成，工作電壓3.3v。
初始時會對63C充電至2v，再利用C減少63C儲存的電荷，最後用Buffer輸出。
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  P% M* L% f8 u3 U" {這是時序圖，CLKb為CLK的反相訊號。
; P# M# v  o6 M5 E+ r參數規格要求DNL<0.5 LSB，在比賽時確認有達到標準，但成績公布時DNL參數卻大於0.5 LSB。
2 a  R0 y0 \) R以下是成績複查的結果
* ^' ^7 i6 D3 I- O" r         
在63個DNL數值中，前62個都正常，但為什麼在最後一點突然超標，
實在想不出哪裡出錯，拜託各位專家高手替我找出問題。
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9 Y9 M9 |( ?+ m0 h1 o

fordayever

如果確認63C及C charge sharing的結果都符合預期
* s4 C& b8 p0 o可以看看Output buffer的input range足夠嗎?

YMCK

想請問樓主是比full custom的嗎