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[問題求助] 請教VHDL

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1#
發表於 2008-2-1 06:51:17 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
當我宣告如下:5 K2 }/ s* G! A1 Y
A : in :std_logic_vector( 7 downto 0);
/ t3 \5 _& \. a. s5 D; _7 q請問為何只有需要一隻腳就可以代表8 bits,可是我們實際用的IC都是8條資料線,我有點混淆,能否請教大家,指點一下,感激!
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2#
發表於 2008-2-1 08:59:17 | 只看該作者
這應該最基本的訊號宣告格式, 其實它宣告出來是個array, ' x0 o, j3 |( B& w5 C
( 7 downto 0); 共 8 個 bits
3#
發表於 2008-2-4 08:56:08 | 只看該作者

那是8條線,

那是8條線的 bus. 只是用了一個名字.
4#
發表於 2008-2-4 09:39:19 | 只看該作者

回復 1# 的帖子

那是Array或Vector的宣告方式吧8 K5 _; X) h8 i' v6 B
像Verilog 你也可以寫成; P: c/ i( |" j7 i  O7 V8 l
Input   [0:7]  In;
* o/ N, }" o# s# i  g8 N的道理是一樣的
5#
 樓主| 發表於 2008-2-5 16:13:57 | 只看該作者

請教VHDL

原來如此,感謝各方的意見與指教,另外小弟再請教個問題0 M/ K, h% F. _& F  r5 B
% E& o; o( n( Z9 k% M" m
http://www.xilinx.com/products/boards/s3_sk_promo.htm) B! O( a- z* R( p! _  ^

$ C6 j. j. I/ w- R5 C這個網頁上的tool kit哪種比較適合買來自己用?
$ `# p" n* U8 j8 z6 W. F4 @
8 s* L0 M9 a0 ~' {& VSparten 3 跟 Sparten 3E的差異有哪位知道的呢?  |4 U$ T) c' {6 m& G# P6 ^

$ w* y4 G/ I/ `- u7 g我想買一個適合自己練功且又便宜的ASIC tool kit,希望日後也可以支援個人所設計的DSP處理器的燒錄4 O# ]: Z0 z  r* T: L1 ^

, d5 _5 }0 H3 O, V2 v# J) A6 W懇請大家給我點意見,xilinx的產品線好多,讓我實在是有點眼花撩亂呀...
6#
發表於 2008-10-24 09:36:40 | 只看該作者
"A" is the name of bus, it is not line
7#
發表於 2009-6-8 17:30:47 | 只看該作者
其實我認為用哪一種工具都差不多; E  {7 ?1 e5 ?* E
最重要的是看你的需求$ {+ y2 s# u1 v
若你的需求是純練功! d' m! A, U8 `0 f
個人認為用到xilinx太高檔的...." @$ k" i( ?5 W/ W" U5 {+ U5 ?' N
你可以考慮用altera的會比較便宜
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