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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 用verilog撰寫取對數log電路

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樓主: michael6172

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[問題求助] 用verilog撰寫取對數log電路

1^#

發表於 2010-1-26 17:19:27 | 顯示全部樓層

感謝你的程式我也對如何取log感到好奇

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