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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › verilog的基本介紹
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verilog的基本介紹

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hiyato
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1#
發表於 2008-4-11 21:12:30 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
/ T8 a3 a1 H2 F1 B2 L2 U

( b9 Z1 t5 w; _3 k, a1 R: j" }7 e檔案名稱：verilog
1 Z; T$ g* D3 N4 s: r; ~1 S  M4 R檔案大小：658K, I& P$ Y% A% t4 k$ y
檔案內容：中文
; l$ L0 Q, N' a4 [. K檔案簡介：verilog的基本介紹，對於新上手的學習者，建立基本觀念

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2#
發表於 2008-4-13 00:35:12 | 只看該作者
小弟我想看看Verilog HDL和VHDL有何差別，還是一樣的東西??
6 t9 U" ]/ e* s" O% N/ l0 [' F* j. Z1 o) T0 T6 g
謝謝hiyato熱心的分享!!
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rsun49
3#
發表於 2008-4-15 23:51:56 | 只看該作者
thank for ur doc..........................................................
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ricky000
4#
發表於 2008-4-27 03:44:15 | 只看該作者
謝謝熱心的分享!!: Y+ [( X! u+ F/ @
謝謝熱心的分享!!4 D. E0 H* e+ g
謝謝熱心的分享!!
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u9011311
5#
發表於 2008-4-28 21:03:30 | 只看該作者
英雄惜英雄謝謝熱心的分享!!謝謝熱心的分享!!希望對我們這些初學者有幫助！
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tear086
6#
發表於 2008-5-11 16:45:35 | 只看該作者
谢谢楼主分享。…………………………………………………………

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sjhor -3 敷衍回覆！

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kevin
7#
發表於 2008-5-12 13:44:10 | 只看該作者
thank you for sharing this material

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參與人數 1Chipcoin -3 收起 理由
sjhor -3 敷衍回覆！

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usefun
8#
發表於 2008-5-13 14:55:17 | 只看該作者
好想看看 這個跟verilog的書有何差別 = =
4 U: @$ P6 b  j, {) V 可是要用買的，' f, K1 E. T& W2 S5 Y
不知用怎麼用
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9#
發表於 2008-5-14 17:46:10 | 只看該作者
好東西 感謝大大的分享" d( j8 c. O* I
靠人不如靠自己
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10#
發表於 2008-5-29 20:14:04 | 只看該作者
感謝你的分享( \( A- o4 e. R* P- i& ^
感謝你的分享
9 @7 m& w+ r: a% rThank you for your share
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40506666
11#
發表於 2008-7-15 09:58:38 | 只看該作者
謝謝您的分享                                                    $ F0 {% k! o0 h1 d. h
我正好在學習nios
1 g/ a' O: d. D+ w4 f  U謝謝您了
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eliotj
12#
發表於 2008-8-18 09:05:05 | 只看該作者
Verilog新手
" S* Z. E  q# j正\想學習verilog
) u6 r0 {2 A) K+ O- s; q  z* A感謝大大提供
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uncommon
13#
發表於 2008-10-10 18:15:02 | 只看該作者
基本的語法是我所需要的..." G3 C! V8 g2 v4 L: H
/ Z0 t3 ]7 }( }. R* d- T
看書看半天都沒有頭緒...
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qazjken
14#
發表於 2009-7-23 12:02:47 | 只看該作者
感謝大哥的分享 小弟我正在學習verlog 遮將對我有很大的幫助
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15#
發表於 2009-11-1 17:09:54 | 只看該作者
真是太感謝了~~這東西對我這個初學者~一定有莫大的幫助~
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16#
發表於 2010-1-6 09:59:06 | 只看該作者
非常不錯的資料！對於剛踏入這塊領域的新手，剛接觸 Verilog的人是一個很好的教材! 感謝分享！！！
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cch39
17#
發表於 2010-2-24 17:28:33 | 只看該作者
這種對Verilog的初學者來說真的是很棒的教材, 感謝分享
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k369
18#
發表於 2010-3-3 10:22:35 | 只看該作者
That is very good verilog data. thanks.
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19#
發表於 2010-4-28 16:30:48 | 只看該作者
我也是verilog新手, 有這麼方便的東西3 U+ ]  V" Y+ I. F! k# G
想當年數位邏輯設計的課都用麵包板都線路0 p% z2 ^( T; Z" ]; }2 ?4 M
現在有這麼方便的東西真好
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20#
發表於 2010-9-29 01:32:23 | 只看該作者
哇哇～～正需要這個，新手中
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