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ADI 全新的 RF 設計工具簡化 RF 系統的開發 - RF 信號鏈計算器以及 PLL 合成器工具加快了上市時間
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台北2011年6月21日電 /美通社亞洲/ -- Analog Devices, Inc. (ADI)美商亞德諾公司今天發表兩套廣受歡迎的全新 RF 設計工具。ADIsimRF™ 設計工具乃是 ADI 完整 RF 數位功能區塊產品線的搭配用軟體，能夠讓工程師利用 ADI 的 RF IC 產品線所有元件建立 RF 信號鏈的模型。ADIsimRF 1.5版的加強部份包括有對於信號鏈中信號位準的更高可視性、設定 RMS 與峰值功率警告臨界點的能力、以及量測級間功率耗損的計算器等。ADIsimPLL™ 3.4版開發軟體已經升級至能夠支援 ADI 領先業界 PLL 產品線中的新產品，像是使用於基地台與一般用途應用領域的 ADF 4351 PLL 以及使用於衛星應用方面的 ADRF 6850整合式寬頻接收器。這些設計工具的新版本可以從 ADI 的網站免費取得。
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ADIsimRF 設計工具能夠對 RF 信號鏈中最重要的參數包括串級增益、雜訊係數、IP3、P1dB、以及總功率耗損等進行計算。ADIsimRF 工具也包含有來自於許多 ADI 的 RF IC 嵌入式資料，設計廠商可以利用下拉式選單輕易的加以存取。元件表能夠對零件的挑選提供協助。下載此工具：http://www.analog.com/adisimrf 。

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ADIsimRF 1.5版的主要特點

5 w6 Y$ M$ z% \. e: E支援 ADI 最新的高性能 RF IC
1 M. l- c) B9 O" u# c透過由每個級的1 dB 壓縮點（P1dB）所回返峰值與 rms 所顯示的每級 RF 功率提高對於信號鏈中信號位準的可視性
! m3 s. j$ x1 Z" O! Y6 ]" @6 o設定峰值對平均比例與回返臨界點的能力，以便當特定級中的 rms 以及/或是峰值功率接近1 dB 壓縮點時可以警告使用者。
藉由非匹配式阻抗位準、以 nV/√Hz 表示的電壓域信號位準例(如 rms電壓、峰值對峰值電壓、與雜訊頻譜密度等)、以及信號品質度量(像是 SNR、SFDR、IMD)、與 ACLR 等計算介於兩組相鄰元件之間的級間 RF 功率耗損。
" ~2 H3 S, Q/ I/ I  V& n相容於 Windows XP、Vista、以及 Windows 7
ADIsimPLL 3.4版增加了對於最新高整合度 PLL 的支援能力

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ADIsimPLL 設計工具是一套綜合性的 PLL 合成器設計與模擬工具。所有會對 PLL 性能產生衝擊的關鍵非線性效應，包括相位雜訊、分數 N 突波以及抗間隙脈衝都能夠加以模擬。與先前版本完全相容的 ADIsimPLL 3.4版設計工具將耗費時間的迭代（iteration）從 PLL /合成器開發程序中予以去除。ADF 4xxx 合成器家族能夠使用於許多的應用領域，像是無線基地台、LAN、行動電話與 PDA、寬頻無線存取、工業、儀器與測試設備、衛星、聲納、以及 CATV 等。ADI 的 ADIsimPLL 3.4版設計工具提供對於公司最新 PLL 合成器的支援，包括使用於基地台與一般用途應用領域的全新高整合度 ADF 4351 PLL，以及使用於衛星應用領域的 ADRF 6850整合式寬頻接收器。下載此工具： http://www.analog.com/adisimpll 。

8 v4 v% j; C. A  o) ^, l9 W涵蓋完整 RF 信號鏈的 RF IC 產品線

$ J) M: n5 Z0 nADI 以其設計的技巧、對於系統的了解、以及製程方面的技術等獨一無二的組合，提供涵蓋完整 RF 信號鏈的最廣大 RF IC 產品線，其範圍從領先業界的高性能分離式 RF 功能區塊一直到高整合度的多功能單晶片 RF 解決方案。這些產品都受到廣泛的免費設計工具、評估用電路板以及其它的設計資源所支援，能夠使 RF 系統的開發更為簡易。

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德州儀器推出業界最快速、最高效能類比前端 推動毫微微蜂巢式基地台與可攜式軟體定義無線電應用效能升級
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; G) {1 m! g; [4 Y, L' W
- }1 X3 @" u3 J* d5 n(台北訊，2012 年 1 月 30 日)   德州儀器 (TI) 宣佈針對毫微微蜂巢式基地台 (femtocell base station) 與可攜式軟體定義無線電 (SDR) 應用推出兼具業界最高速度與效能的類比前端 (AFE)。該低功耗 12 位元 AFE7225 整合雙通道 125 MSPS 類比數位轉換器 (ADC) 與雙通道 250 MSPS 數位類比轉換器 (DAC)，訊號雜訊比 (SNR) 提升 2 dB，DAC 輸出電流提高 5 倍，運作速度比同類產品快 25%。

除了 AFE7225，針對較低頻寬、低功耗應用同時推出 12 位元 AFE7222。該元件整合雙通道 65 MSPS ADC 與雙通道 130 MSPS DAC，全雙工運作時功耗僅為 398 mW，全速半雙工接收模式下，功耗則為 212 mW。

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與同類 AFE 解決方案相比，AFE7225 與 AFE7222 整合更高的數位訊號處理功能，可提高設計彈性。此兩款產品是業界獨無僅有的混合訊號AFE，支援獨立收發、32 位元數控振盪器 (NCO) 與序列化 LVDS 輸入輸出選項，與增益、相位及偏置不平衡的獨立收發正交調變 (quardrature modulation) 校正。

AFE7225 和 AFE7222主要特性與優勢

; }$ @1 `' `& T' C) f•低功耗：深度休眠模式 (deep-sleep mode) 下功耗僅為 12 mW，喚醒時間僅 13 us，在輕度休眠模式 (light-sleep mode) 下功耗僅為 120 mW，喚醒時間則為 5 us；
+ r' [3 J' X$ @; D6 y7 @1 q•高效能支援更清晰訊號：針對 3G W-CDMA 蜂窩訊號 (cellular signal) ，雙通道 ADC 可實現 70 dB 的 SNR，而雙通道 DAC 則可實現 75 dB 的相鄰通道滲漏率 (adjacent channel leakage ratio)；
+ Y8 X' r( {# ^4 R( l/ t•訊號處理幫助降低 FPGA 閘門數量、介面速度與成本：二者都支援獨立收發數位區塊上下轉換，提供 2x 至 4x內插 (interpolation)、2x 抽樣 (decimation) 、粗調 (coarse) 及 32 位元 NCO 頻率混合器、針對正交調變收發的增益、相位及偏置數位校正，及峰值／rms 功率計算；
* U) d+ i7 D5 r; g! Z' z•高整合度降低系統成本：雙通道 12 位元輔助 DAC 及雙通道輸入 12 位輔助 ADC，可減少獨立監控與控制裝置需求，節省電路板空間，降低功耗與成本；
8 j& Z, G+ t* b! z•為設計人員實現高度彈性：數位 DAC 輸入與 ADC 輸出可針對串列 LVDS 進行配置，減少接腳/軌跡數 (trace-count)，實現長軌跡訊號發送 (long-trace signaling)，低功耗介面的多工 12 位元 CMOS 也支援兩條匯流排的全雙工，或一至兩條數位匯流排的半雙工；

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AFE7225 與 AFE7222 可用於外差 (heterodyne) 或直接轉換無線電架構。對於外差無線電，AFE 中單一 DAC 通道建立大約 100 MHz 的發送中頻 (IF) ，而單一 ADC 通道則可擷取超過 300 MHz 的 IF，毋需使用通道即可關閉以節省電源。針對毫微微蜂巢式基地台，AFE 結合高品質 RF 元件，例如具有本地振盪器 (local oscillator) 的 TRF372017 IQ 調變器，及 TRF371125 IQ 解調器等，可提供大型蜂巢式 (macro-cell) 效能。

# P1 F" a1 @6 D工具與支援
  ?$ L7 a8 B/ ?( f* P評估模組現已開始供貨，建議售價為 499 美元。AFE7222EVM 與 AFE7225EVM 皆包含 TRF370333 IQ 調變器與 CDCE72010 時脈抖動清除器，DC/DC 轉換器與低雜訊 LDO 等 TI 電源管理元件，提供位元到RF (bits-to-RF) 的完整原型設計與參考設計。
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IBIS 模型也已開始提供，以滿足驗證電路板訊號完整性的需求。TI E2ETM 社群高速資料轉換器論壇提供技術支援，工程師可在此諮詢問題，幫助解決技術難題。
       
1 L1 X8 G/ q) B+ q供貨與價格
5 B: [. _; `3 W: ~: x3 R6 d採用 9 mm  x 9 mm QFN 封裝的 AFE7225 與 AFE7222 均已開始供貨。AFE7225 每千顆單位建議零售價格為29.5美元，AFE7222每千顆單位建議零售價格為 19.5美元。