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回應3樓大大的答案...8 J5 E. ^. d D7 s, Y& r7 ?, Q# |
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我猜有水紋波應該跟fpga沒關係, 資料latch錯了會出現比較像雜訊的東東, 水波應該是來自於電源對DAC的干擾, 這個干擾也有可能透過 RGB565 數位的信號干擾, review一下線路應該很容易找到答案
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第2個問題: cache的設計要看你要做1way / 2 way /3 way的哪一種cache. 複雜的cache架構雖然不好設計但是performance會令你滿意的 dma controller在bus算是個master, 在multi-channel dma設計中還需有個arbiter來仲裁, 而且這個東東跟bus architecture / protocol也有關係, 這些相關的知識其實好好去翻計算機組織與結構的書相信有很多重要的知識, dma controller還可以去參考別人現成做好的一些design
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$ m# r! d @/ r- K以上希望能有幫助...
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[ 本帖最後由 tommywgt 於 2007-1-19 11:35 PM 編輯 ] |
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