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你最想瞭解IC LAYOUT哪些方面的知識?

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1#
發表於 2007-9-10 13:41:52 | 顯示全部樓層
原帖由 君婷 於 2007-9-10 05:06 AM 發表
, B4 n( s+ u+ L" T  [- P# J對初學者的我來說,calibre 驗証中的DRC  LVS 的錯誤訊息及設計規則中的command file 內容是否全看的懂 ?為應徵 工作前必須務必作到的!
' g& |, Y5 q7 |8 x( @像drc  lvs  裡的除錯訊息 似乎非直接以一段完整的英文清楚表示那裡出了 ...
( v6 d; l. ]6 F1 v, l! |
6 V, F9 c, Y+ E0 y. g3 ]
關於DRC的錯誤,說真的不應該以cmd file 的為準,應該是以fab的TLR(topological layout rule)為準/ S. w, l; _/ h0 G7 {
因為那是正式的文件,cmd  file 正常來說應該是要可以將錯誤完全找來,但是cmd的寫法因人而異,
9 k# Z1 e% x2 Q0 ^所以有時會有誤判的時候,由cmd 去找rule這好像反過來了。' E/ N& |$ n" t$ E7 y
  Z- }' J/ g# m5 ?- V
建議應該是先找文件,邊畫邊查,或是看完了再畫,這個看每個人的習慣。0 U5 u: S6 C5 q8 L/ d! E0 N, I! r

3 y3 F# d+ H6 _$ {& {: B% E& mLVS的部份這個比較難說明,很多是經驗找出來的,所以下面的說明看不懂的話請多包含(個人表達能力不太好)' H% N' K4 D0 c; ^
/ }  v& m2 m1 W4 c2 }
LAYOUT   Z2 R. O' H$ F2 ~# B. c
最TOP的cell打的text,跟相對應的metal接觸到之後算成一個port點;對應於netlist 最top cell的pin點
1 F5 t! r# k- y0 e4 P' m4 rex:
& ?6 L8 d5 E" y
1 ^8 E- N% X, M+ Xlayout 的cell上面打了top  metal 的text A、B、C、VDD、VSS、clock3 p7 B; R( `% j' L) ]) y: b* o
在netlist 的top cell看到的
4 ^6 M: R# T& W* ^( K.subckt topcell A B C VDD VSS clock
, O8 B+ C% E. `) l
. R/ c6 E0 a* z7 G( k7 k3 }: i以上應該相符合
! g+ V+ Q( j2 O' v( N: X' s* i" S! }% ^8 S
如果一邊有缺在lvs 就會出現 多出來的port 看是在layout 還是在netlist
4 w4 ?7 n8 @. l# v! a$ ~! F===========================================
5 J$ `6 Z- h7 @7 d: s  O# iport對了後先解short問題,vdd&vss有short這就不用玩了3 R% C, f9 }: j2 c* M
這個部份只能看report highlight的部份去看了這個真的看個人的眼力@@+ q2 q) \' y# g0 z0 l& q
+ a' Y) X$ _( ^+ J4 w
再者看有沒有soft connect
- ]0 V) k9 U/ Z; r3 g3 b這個部份在有多組電源名稱時會發生
7 \: i' ^, I; V  A, Qex : DVDD DVSS for 數位
; \( }* {: T& L" p+ C* u: O      AVDD AVSS for 類比% }# d- H! l9 h% i8 W
      VDD33 VSS33 for IO ring使用. o. S+ k* t; i0 a( Q) N8 O

: f. H3 v; }  H2 f+ b& P正常gnd在sub 實際上都是接在一起的,但是在這個情形下會產生在底層short的情形3 b$ y" |8 x% q# K  e4 k
現在的cmd通常會有一層psub2 或是相關的層用來把sub切割成二塊,以利LVS的進行。
: C# c2 @4 B, |; M==================================================
' D) D8 J# i( m5 i* G/ K其他一些比較平常的狀況
2 y4 O5 o- j1 I- h5 ~layout 上2條net對上 netlist上面的1條net# D, V2 c: r/ [8 _0 v
===>通常是open掉了
8 ]6 J" |4 ?, y: N# G, q$ Rlayout 上一條net對上 netlist上的2條net
" j, [/ J7 \' x===>應該是short到了0 ^- O( [( ^. V0 L5 I8 k0 Y# k7 L
! U$ x( e+ }5 ]2 s0 P8 r1 k
2對2 互換的線
6 z( c. m0 U. r1 s7 o3 I* t你應該是接錯了,換回來吧,不然就是一種情形gate的設定是不是有change到
3 C) W" G, Y: b% y9 d7 c- K0 S這個是在串連時常會發生,雖然function可能是相同的,但是還是換回來比較好。. g! x% ]. p- F+ A
這個好像在cmd 有選項可以調整的) ~/ W% H6 o% Q
==================================================- b" ?! F* Z$ S! F: h
有時候看看文字的report上面會有很多訊息的,但是不知為啥很多人不喜歡去看....?_?8 ~3 f3 T9 m, c3 D
是覺得煩還是看不懂?3 |  ]! p% F" N3 P
像一個nand2 看是認出來為一組p並連,n串連...有可能是沒吃到power或是gnd,
# k- [. \0 M. u! W! Y( O; L  C因為基本的閘應該都會被找出來呈現的,像nand2, nor2, Inv, 這些。+ c$ p$ i8 ]& b$ B) y
==================================================3 z- v: L9 j1 a

3 P/ {1 n/ A; j: a3 y個人在工作上是用calibre的,上面僅供大家參考....LVS的除錯有時用說的真的不容易表達
" h; |3 j7 b* j& I希望對大家有的助益。

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2#
發表於 2007-9-11 11:53:35 | 顯示全部樓層
TLR...跟cic應該要得到吧,要不到就很其怪了,沒這個正常不能去layout的。
! |! r% n9 m% x% t  g這個在公司還是算機密的文件...因為這個是公司跟fab簽約後才可以download的。* L$ @! z+ o7 x4 f4 }  y
1 Y! H8 C# b, f
各種EDA的cmd 寫法是有些不同,但是很多部份是用羅輯運算的,其實看起來是不會差太多,
2 `! z  v5 e5 D3 c* l, ^只是一些指令的不同。2 S/ k9 T% `# ^' D3 c( h. F

0 \' R5 T' v1 R7 `4 g: X7 s* J這個部份真的沒看過有書@@,因為每個製程不全然相同,而指令的部份通常有說明書...) y7 t+ G# i/ {
所以這個部份主要是查指令的工具書看他的寫法吧。
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