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[問題求助] PLL 的實現方法?

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1#
發表於 2007-6-8 19:19:44 | 顯示全部樓層
問一下下...# D! j0 j2 h+ g, m; u

2 I  ], y0 A( [6 h/ V你有HSYNC可用嗎? MODE 有固定嗎 ?' t$ N4 N( \" P! j; W
有的話至少已經上 KHz
, J" V9 }" \9 @* S# {2 v4 q而且就倍數來說一定也會跟VSYNC同步吧
2#
發表於 2007-6-10 21:50:08 | 顯示全部樓層
... 這樣說吧
! N" a' {; ], X( r' @! L# @如果有 PIXEL CLK 就用它除頻
0 U7 h5 g) X# h5 X3 D0 S9 W如果有 HSYNC 就用它倍個幾次
  g; M+ G/ G" r3 _" W) N8 L6 D: w
2 ]1 h. }1 c3 e1 W+ x' Y' S$ w因為 PIXEL(DOT), HSYNC, VSYNC 之間有一定的倍數關係+ u, u) A( [! H3 O3 h% E
( r0 C4 U& {1 d$ o) D. A
   640x480@60Hz => 25.175MHz (39.7ns)
' x4 g) ^: V, o, {7 s   DOTx800=HSYNC, 39.7ns x 800 = 31.469us
+ \3 f, G( }! [' a3 ?1 ~; F- K( c   HSYNCx525=VSYNC, 31.469us x 525 = 16.52ms (60Hz)6 I0 Q  @$ p; Q! Q' o( ^0 T5 q
所以這樣的CLK一定會和VSYNC同步 (詳見VESA Monitor Timing SPEC)
9 M; V4 b' r: {8 C
3 g8 R! ]. R- y; x2 T& Y接下來如果要VSYNC時不出CLK.. 那就用個AND閘吧 (看你用哪個MODE, SYNC有High或Low)0 M# \& G& s5 _: y1 \8 z3 u! m# l% [2 C
6 ~5 w5 \5 D7 u
還是我想的清況和你不同呢?
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