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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 在Layout時最花時間的工作是....
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樓主: jauylmz
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在Layout時最花時間的工作是....

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samgu
21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩，因為一個好的 floor plan 除了能讓訊號線走的順之外，也可以節省面積# T0 |- N) G8 x' y* v' ?
2.接下來我覺得比較重要的是 power and ground line 的跑線，因為要走的順才是最重要的，而且若POWER途中一直換線其實也會降低它的電流) S% o1 q: Q2 Y+ \1 }  P
3.接下來我覺得都還好，因為 DRC LVS block 刻好就會 RUN 了 ，另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話！面積會變大∼甚至拉線會亂七八糟ㄉ∼
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yhchang
23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠% g6 E% T" }3 u  K
你勉強把東西 塞進去之後  好不容易做完1 k0 B& G9 L& Y
結果電路圖又變了  你就完了
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yhchang
24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說0 b$ M4 I% z* c
一直改圖對LAYOUT來說是最花時間的. {7 _/ s9 a- n) ]% c" w$ T7 v+ L; r
或者是 沒有看清楚 RD寫的NOTE
; D7 ?" S: p( q" h! g! q導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的: r9 O" I% Z+ H% o0 t

/ U9 G. c0 S- e3 ^( G* s$ e有時候我們公司RD也不想讓LAYOUT一直改
, x& B0 B7 S+ P/ H- I6 l+ G只是因為有時專案太趕5 ?6 y" p( S% z# P6 A2 J
所以只好跟LAYOUT同時平行做. q! O- T1 Y& S2 |+ [; U
這樣就容易電路常常會大翻盤
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qwertmn
25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~! {) ?) o% ?! ?. f  v4 S, D$ O9 Y
光是排列就會影響後續走線
5 q, l2 O0 r$ p所以要特別注意~~~
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ynru12
26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
% u) ^7 p) w- E2 U, A最辛苦的就是改圖~原本己經畫好的，但是rd突然說要改圖* K  v; ]: a# g
然後整個的大小不變，但是改的地方，又比原來的大一些
) F7 {6 j0 k3 [( m3 P9 d這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好，所以floorplan是很重要。
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jauylmz
28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非
+ {* E( g* _! S( ^2 O+ ]0 B; z1 S4 j9 L8 X
我花最多時間的是在思考，
1 @7 M- p- R2 y一個5天該完成的案子，我可能會花去2~3天思考。0 w5 E0 n' Q9 |2 \# ]6 M5 l9 O
事前想的仔細，6 f" }2 D5 @7 Q: G5 k# S/ \
開始動手layout一直到驗證完成都會很快而且順利。
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fei
31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难，最能体现实力！。。。。。。。。。。。。。。。
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sj1130
33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間，可能是因為剛接觸Layout沒多久，經驗不足顯得更無力！( a4 ?- Z7 |. e6 c; R
整合這部份，如果是自己獨立一人完成，雖然時間耗費較多，但是就跟寫程式一樣，如何去安排自己的line能走得順
' f$ m! z' N1 Z/ |: O3 k  u我想這才是最重要的！重點一句：還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎; `: _# ^8 |5 b: Z1 _( f; ^
LAYOUT我覺得每項都很花時間
& X; I7 {  V8 F* N4 b# p不管是佈局還是LVS/DRC7 H6 g% n) M+ Y: A
每項都得小心翼翼
* }7 j) E  Q/ W8 q; o做快不見得好
" y( ^- S9 p5 S* X  h做對才是重要
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app
35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~
" L" a" N- ~( d/ @2 Q因要如何將每個block充分擺到適當的位子~) d4 b5 w2 c9 {) O
這是一種學問~
& M4 A2 a! j7 S3 P6 k因擺的好的話~7 D5 E8 W3 }2 Q$ Q/ S
其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
4 ^4 X- e( a! y% i# Y/ l6.  整合 Chip Integration* u* A  I: v/ s
7.  溝通 communication
& b1 N4 M- }% w# _3 t這三個最麻煩
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brooo
37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧$ H% y$ h1 _% l; F+ `% E$ Y3 s
# A7 Z, E3 _% O. N- u
在layout初期就要花很多時間先想好如何排列9 h5 J% W# p) Z& c

( N8 A3 d' T( \0 r, l想好後，反而才會省下大量的時間
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AaronChu
38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...- w& H7 R/ u  H' {
要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   4 @$ S* \+ n: |' x
) U! u$ x# ^% b& Y; O7 o& ?$ i1 S5 d
其他就會很快   相對LVS 問題也比較好除錯; n* S/ c! l0 T3 F

0 u6 _" n$ Y* a. n$ o  Z, \1 IHR.概念有  應該DRC LVS比較不會有問題吧
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kevinpu
40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
3 o4 V# }# a2 |7 X% S. I再整合時也會是另一個問題
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