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樓主: jauylmz
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在Layout時最花時間的工作是....

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21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩,因為一個好的 floor plan 除了能讓訊號線走的順之外,也可以節省面積
3 Q. O6 ?; ~! f& \# u2.接下來我覺得比較重要的是 power and ground line 的跑線,因為要走的順才是最重要的,而且若POWER途中一直換線其實也會降低它的電流; [5 Y. }3 }  w4 \( x3 _' S" M
3.接下來我覺得都還好,因為 DRC LVS block 刻好就會 RUN 了 ,另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話!面積會變大∼甚至拉線會亂七八糟ㄉ∼
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23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
! i7 ^) F1 w- h8 H1 b' p/ U你勉強把東西 塞進去之後  好不容易做完
3 Z# F/ m5 l# l! O1 a+ t結果電路圖又變了  你就完了
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24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說
6 s4 g/ {; c$ M9 g% r一直改圖對LAYOUT來說是最花時間的- v) x- r; w, z) l/ l
或者是 沒有看清楚 RD寫的NOTE
5 K& Z& Y( J$ I; G導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的
6 V8 U) l- u7 p9 [  t4 Z6 Q: \
8 {! b$ j7 g; G有時候我們公司RD也不想讓LAYOUT一直改4 |& Z/ ^7 Q! M) l. M0 @7 |
只是因為有時專案太趕
9 L, i6 K+ f' U3 y所以只好跟LAYOUT同時平行做$ O. @+ A7 g) U4 {' ^, M
這樣就容易電路常常會大翻盤
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25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~
& J* [+ I4 q/ G' t5 l$ z2 w光是排列就會影響後續走線
+ m6 t. Y6 P# K所以要特別注意~~~
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26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的
0 L8 M, P) F* l% @8 g( ~最辛苦的就是改圖~原本己經畫好的,但是rd突然說要改圖
# `  H7 C7 b$ P% h) w/ T然後整個的大小不變,但是改的地方,又比原來的大一些9 J; v- [( [0 ]' t8 n. s
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好,所以floorplan是很重要。
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28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非/ w  f. g8 T$ v1 F! ~, o1 I

" U( _' f" R: Q9 k5 n我花最多時間的是在思考,. \5 Q$ i2 L. k7 G
一個5天該完成的案子,我可能會花去2~3天思考7 y6 k# X0 s9 ]6 o
事前想的仔細,% {( z) d- U6 f; V% D5 E
開始動手layout一直到驗證完成都會很快而且順利。
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31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难,最能体现实力!。。。。。。。。。。。。。。。
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33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間,可能是因為剛接觸Layout沒多久,經驗不足顯得更無力!0 Z1 B8 C. z8 D% q. q
整合這部份,如果是自己獨立一人完成,雖然時間耗費較多,但是就跟寫程式一樣,如何去安排自己的line能走得順" u  C% @$ ~# m+ m2 E. \% I4 @  y
我想這才是最重要的!重點一句:還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎
. p4 M# G3 g8 p# LLAYOUT我覺得每項都很花時間2 d7 G. C& q& ]' L& B9 t$ T
不管是佈局還是LVS/DRC
8 i% x# [" `$ W' n) Y4 Q每項都得小心翼翼
  O% u" I7 p( K3 H7 m做快不見得好
  t9 \5 `8 r5 [- c做對才是重要
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35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~2 n( i# V: w. S6 T
因要如何將每個block充分擺到適當的位子~8 e* A  Z$ ?" G- r3 m) H- v& s0 h0 i
這是一種學問~: c& W3 D) S- Z) o
因擺的好的話~
1 w1 n1 Z, t  R其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   
9 m$ M) Y4 A+ J/ f6.  整合 Chip Integration) G- f. Z# e% w. M) e. |' W  ~
7.  溝通 communication
( e$ G7 z+ o0 O; q$ f這三個最麻煩
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37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧2 H8 b" r5 L$ Q' N- ~! ?0 V

' v8 y( F; P1 L( ~( @/ z4 F$ X2 J! W在layout初期就要花很多時間先想好如何排列
: ?/ z/ W% J. j! e" ?+ I4 |3 }3 o3 [# N/ \( X
想好後,反而才會省下大量的時間
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38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
- ~$ N; G7 @* j- `! B+ j) I要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   , B1 \+ W( T2 l! s* a4 {  u+ |

* k6 F9 j9 G7 Z# _& p- f4 b3 t其他就會很快   相對LVS 問題也比較好除錯% ~! a$ r9 s' Z& H) S" l
9 H# S: D# @$ ~0 X9 v6 Z2 G
HR.概念有  應該DRC LVS比較不會有問題吧
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40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,2 t( W8 L$ r% o  R
再整合時也會是另一個問題
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