TSMC與CADENCE共同合作 為無線IC設計提供65奈米的製程設計套件與完備的設計流程

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Cadence益華電腦低功耗解決方案雀屏中選
! \* I* J8 N1 {1 w1 f9 p; ^納入創意電子(Global Unichip)的PowerMagicTM 低功耗設計方法中

     創意電子的PowerMagic TM 65奈米設計方法佐以
# d3 D+ ~9 i5 e! o' e& n- `5 M( _. \             一貫以CPF為基礎的Cadence益華電腦低功耗解決方案

2009年9月14日 ; 台灣新竹 – 全球電子設計創新領導廠商Cadence益華電腦今天宣布，創意電子(Global Unichip Corporation，GUC)將以CPF為基礎的Cadence低功耗解決方案，整合至其PowerMagicTM設計方法中，協助客戶將複雜的低功耗ASIC設計實現最佳化。
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; Y  J  @# m# i2 X: s- a2 m, `創意電子在PowerMagicTM設計方法，針對ASIC設計驗證與實現，整合Cadence®低功耗解決方案 (包括Cadence Encounter® RTL Compiler、Encounter 數位設計實現系統(EDI)與Encounter Conformal® Low Power)，以及其內部自行開發的設計工具，開發出完整一貫流程的低功耗ASIC設計流程，包括先進的動態電壓頻率調整(dynamic voltage frequency scaling，DVFS)技術。而這關鍵技術能夠在同一晶片上實現多重可變電壓(voltages)的電壓區塊(power domain)，也能夠在無需顛峰效能時降低電路電壓。

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+ R# c1 w# e. a$ ^0 ?% e9 W2 C3 m1 Z創意電子設計服務副總經理謝紀強表示：「經由我們的工程設計人員實際測試及實作，Cadence益華電腦低功耗解決方案足以順利完成65奈米製程、千萬電晶體的低功耗晶片設計最佳化，同時也正確地完成10個以上電壓區塊與50個電壓模式的設計及驗證。」「Cadence益華電腦低功耗解決方案和我們的PowerMagicTM設計方法相輔相乘，完美的整合讓低功耗設計實現與驗證更有效率，並協助ASIC設計工程師解決複雜的低功耗設計議題。」
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Cadence益華電腦低功耗解決方案從早期的設計規劃開始，涵蓋前端設計、合成與實體設計實現，提供設計到signoff的完整流程方法；在每個階段都能夠透過功耗估計與分析而實現一致性與收斂。除了設計實現之外，更佐以完整的靜態、動態與正規功耗驗證技術，以達成前後一致
(closed-loop)的驗證方法。這個完善整合、高度自動化、具備功耗意識的解決方案，不僅擁有業界頂尖設計服務支援，亦獲得以功耗為焦點的業界聯盟，如業界最大的功耗聯盟(Power Forward Initiative)與Si2低功耗聯盟等的支持。
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Cadence益華電腦數位設計實現研發資深副總裁徐季平表示：「創意電子在PowerMagicTM方法中納入Cadence益華電腦低功耗解決方案，讓設計團隊實現了絕佳生產力與品質躍升，也協助客戶提供卓越的低功耗設計能力。」「這個最佳拍檔一定能夠為創意電子的客戶創造最高的價值。」


[ 本帖最後由 heavy91 於 2009-9-14 02:17 PM 編輯 ]

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【2010年5月19日．台北訊】 CEITEC S.A.今天正式宣佈與EDA360全球領導廠商Cadence® Design Systems, Inc. （NASDAQ: CDNS）締結聯盟，將在半導體的設計上採用Cadence廣大的電子設計自動化（electronic design automation；EDA）產品與服務。

* ?7 |! _& M5 H" G9 X; w　　Cadence全球策略銷售副總裁Neil Zaman表示：「這項合作協議對Cadence和CEITEC S.A.雙方來說都是一項重要發展里程。巴西被公認為全球科技成長的重點地區，而我們很高興有機會協助拉丁美洲半導體產業創始暨領導廠商克服技術和經濟障礙。」

* r& Q/ Q2 f( l6 o　　CEITEC S.A.執行長Eduard R. Weichselbaumer表示：「這項合作協議將有助於CEITEC S.A.拓展在無線射頻辨識（radio-frequency identification；RFID）、無線通訊，與數位媒體等關鍵成長應用方面的晶片製造技術。我們很高興能與Cadence合作並運用其世界級的EDA解決方案。」
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Cadence的技術在現今高度複雜的積體電路科技、印刷電路板，及電子系統發展中扮演重要的角色，為消費性電子、網路與電信設備，以及電子系統提供必要的基礎架構。Cadence總部位於美國矽谷，營運據點遍及全球。

CEITEC S.A.的營運目標是要開發以大量市場為訴求的頂尖半導體產品，供應拉丁美洲和出口至全球市場。CEITEC S.A.將利用巴西的區域影響性、領導地位，和經濟力量，加速拉丁美洲電子產業的成長。

關於CEITEC S.A.
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　　總部位於巴西的CEITEC S.A.，以開發和生產特殊應用標準產品（application-specific standard product; ASSP）為重心，涵蓋RFID、無線通訊，和數位多媒體市場區隔。該公司設計中心位於巴西阿雷格里港（Porto Alegre），肩負巴西微電子產業半導體開發的策略任務。CEITEC晶圓廠現在進入最後的設定與驗證階段，並擁有拉丁美洲第一且唯一的半導體製造設施。CEITEC S.A.的任務是要讓巴西成為全球先進微電子領先國家，詳細公司資訊請參觀www.ceitec-sa.com。

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創意電子(Global Unichip)擴大採用 Cadence益華電腦技術陣容加速其 IP開發時程
客製化設計與 DFM產品協助其晶片實現 (Silicon Realization)

3 B$ d. @8 q1 _: x; P: {" f2010年 10月 8日台灣新竹 –全球電子設計創新領導廠商 Cadence益華電腦今天宣布，創意電子 (Global Unichip Corporation，GUC)已經採用 Cadence益華電腦 Virtuoso客製化設計技術，以加速其高速介面 IP的開發作業。創意電子也已採用 Cadence益華電腦的可製造性設計 (design for manufacturing，以下簡稱 DFM)技術，運用於先進製程 SoC設計。
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Cadence益華電腦一直都是創意電子的主要 EDA合作夥伴，協助創意電子在不同設計製程中完成設計實現，並達到試產成功。而創意電子由於採用了 Cadence益華電腦客製化設計與 DFM技術，開發出各種高速介面 IP，幫助其客戶達成晶片實現 (Silicon Realization)的目標，這就是 Cadence益華電腦 EDA360願景的關鍵要素。
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  a1 k! M; F* L, H$ L: {「創意電子戮力提供最先進並具備成本效益的晶片解決方案，與 Cadence益華電腦合作讓我們更進一步強化自己的 IP開發能力。」創意電子總裁賴俊豪表示：「我們的高速介面 IP開發，持續幫助客戶在高速網路架構、視訊處理與行動手機等領域的產品，達成晶片實現 (Silicon Realization)。此外，在 Cadence益華電腦頂尖的客製化設計和 DFM技術協助與完善支援下，使得在 SoC設計初期面臨的嚴苛挑戰能一一克服，並加速我們的 IP認證流程。」

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創意電子採用 Cadence益華電腦 Virtuoso Multi‐Mode Simulation (以下簡稱 MMSIM)，運用於邏輯與類比電路之間的 top‐level協同模擬，協助確保試產之前的功能；還有 Virtuoso Layout Suite，讓佈局檢視更順暢。 MMSIM讓創意電子能夠在設計子區塊 (sub‐block)之前建構能夠滿足規格的架構。 MMSIM也透過共通使用模型、 cross‐probing與 back‐annotation等功能，提供獨家環境界面，讓客戶更容易上手。這種紮實由上而下設計做法，能夠縮短設計與上市時程。

此外，創意電子也採用了 CMP Predictor作為 60奈米製程的標準 sign‐off工具，以避免 hotspots產生。還有 Litho Physical Analyzer (以下簡稱 LPA)作為 40奈米製程的 signoff工具，以實現 litho‐hotspot-free的設計。創意電子運用 Cadence益華電腦 DFM‐aware的解決方案 (例如 CMP Predictor與 LPA)，達成更高佳績，使製程變異的不確定性轉變成可以預測的數據，在設計階段就能進一步使影響降到最低。

與 CMP相關 hotspot (如 copper pooling等)對晶片良率有負面影響。此外， LPA—快速且準確地將製造的系統變異列入考量—使創意電子設計人員能夠分析微影 (litho)對於電晶體效能的影響，然後進行必要的設計取捨以滿足設計基準，並提高實體設計實現的良率。

: U& `( i2 ~- y, }; q" A「對於創意電子驗證了本公司 MMSIM與 DFM技術的價值，並擴大彼此的合作，我們感到非常高興。」 Cadence益華電腦台灣區經理張郁禮表示：「作為創意電子的首要 EDA合作夥伴， Cadence益華電腦提供全新的使用者介面，大幅簡化類比設計人員的複雜工作。完善整合的 DFM功能更進一步強化 Virtuoso平台，有助加速創意電子在高速介面應用 IP的開發工作。」