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[問題求助] 一些Layout的問題

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21#
發表於 2008-4-3 20:19:53 | 只看該作者
关于 double guardring,我们的画法是 ntype ring 靠近噪声源. @; R% E/ O+ C
就是说 如果包的是噪声源的话,ntype ring 在里面,如果是为了防止别的噪声干扰的话,ntype ring包在外面
22#
發表於 2008-4-7 23:24:51 | 只看該作者
非常感謝大大的分享
) f( e  \$ V3 |: u非常感謝大大的分享$ e' W( Q6 |% p* m4 X
非常感謝大大的分享
23#
發表於 2008-10-23 14:21:55 | 只看該作者
原帖由 finster 於 2007-9-6 10:31 PM 發表 " ]/ u3 ]: I$ M. g
我是在一篇paper中看到的,不過這篇paper不知被我放在那裡了  }8 s2 d" l. Y2 Y; N2 a. u/ |8 u
另外,你所引用的教課書的公式應是Razavi那本"Design of Analog CMOS Integrated Circuits"中第13章的吧
1 T' I  c- h1 u! G, o- l書上是先決定BJT的顆數比,然後再求出相對應的電阻 ...
: }8 m3 m7 a2 t

+ t( a: t! X5 `3 e! g" @& V! G好像实际确实如此!谢谢! ……………………………………
24#
發表於 2008-12-2 12:56:22 | 只看該作者

非常感謝大大的分享

非常感謝大大的分享; P% f% D1 A; o: G' n
非常感謝大大的分享0 r8 i. B6 v1 x+ f* T- i6 }
非常感謝大大的分享: W2 a- n. B$ j5 x# E8 y# c
常感謝大大的分享
5 ?$ r' {( J8 k' k# t4 r5 L非常感謝大大的分享
6 P* j3 j2 s* j" I* I8 q& d/ e! U7 x非常感謝大大的分享
25#
發表於 2009-8-9 10:47:41 | 只看該作者
1    普通的logic电路影响不大,  不过一些高频信号, 一些delay电路等的还是尽量避免* }3 V6 M8 y1 c2 P, A
) d" e* h+ u" y- y" X( {) `& ]1 [
2    guard ring 最有效果的是p + guard ring,  但是一定一定一定要接到干净的gnd!!!, 这样才能吸收掉noise。  2种都画的话,比只要p+ 好一点点。
" H8 r( E3 ^) j& @2 q
' m- G  P, J$ e6 X3  这个是为了匹配这样设计的,一般都是设计成1:8    ,1:24 。
26#
發表於 2009-8-9 17:24:40 | 只看該作者
最近在做pll的電路。類比數位都會用到。# H: y; V% N4 y. ?# @0 U0 k
各位都好利害啊,每個回文都有參考價值呢∼∼
27#
發表於 2009-8-9 21:57:17 | 只看該作者
剛好要瞭解這方面的資訊,正好做來參考...) q) a9 c# ~  E' S- k

4 t* {8 q) g4 W9 Q' ~  b' @謝謝分享...
28#
發表於 2014-3-28 09:19:44 | 只看該作者
非常感謝大大分享~
; V2 o4 i* e1 J非常感謝大大分享~
& j2 ]2 F# R) N- ?0 U& F. S. M非常感謝大大分享~
29#
發表於 2014-4-23 16:42:21 | 只看該作者
2:pring 接地收集空穴,nring接高电位收集电子,二者纵向结深越深越好;多子ring是为了让sub电位不被拉高或拉低,少子ring收集电子或空穴
30#
發表於 2015-1-2 14:47:45 | 只看該作者
謝謝各位前輩的經驗分享
31#
發表於 2015-5-19 14:25:40 | 只看該作者
19 I6 E4 T' X9 S
怕千擾
  n. Z1 B$ a, g2 E% a( @8 m/ `可以事先詢問rd care的地方,避免跨過即可3 l' L+ P& b7 M& K. W
26 A' ]' W6 O( }/ R6 ~; y( {  F
依pnmos來決定第一圈及第二圈ring* u$ I4 N6 y, B  o
3
5 t4 C0 v& o/ W9 p# J6 ]0 \! N我也是畫9官格
32#
發表於 2020-8-11 22:39:34 | 只看該作者
非常感謝大大的分享
! ~* y( u" t7 s2 F" g6 I非常感謝大大的分享
% c% z) o* S" l. H: c! ]非常感謝大大的分享
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