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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:
5 N- C# B. x5 a+ R/ q% F; F8 R! Z' k& O
想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程4 I! G9 p" [4 V$ s0 z5 o, z
SYSTEMC擅長前段
$ b( j  |* }( v* c/ sStstemVerilog則後段功力相當了得* D0 P+ s4 a  u+ |/ ~  K! R
可惜這兩種標準還無法做有效率的整合
! J7 Z4 U/ E% U8 P; M% ?( H. U學界已經有很好的整合經驗' j. V2 @+ {2 m+ T' ?$ L
但是業界中小型還在探索階段或根本沒有
2 Y# z! \* ?4 s; L+ U1 o' ?* h大型的Design House & Design service company有專門的部門在研究 # x6 Q& t# s/ f9 t6 S
但只是部分導入在複雜的SOC上
! e6 {- H8 M0 s% D. w+ j/ u  f總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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