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[經驗交流] 請問目前業界與學界對於SystemC和SystemVerilog的應用與發展

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1#
發表於 2012-4-20 14:45:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位學界或業界的先進:4 g6 r' D" `; p8 T7 ?. ~$ a

" ^3 P+ n% ^& R& l! X想請問一下,目前SystemC和SystemVerilog的應用與發展,謝謝各位的指教。
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2#
發表於 2012-5-9 09:25:05 | 只看該作者
這包含IC設計的前段系統效能分析模擬到後段的驗證除錯流程" f7 j/ k' w  Z4 {$ f
SYSTEMC擅長前段 ! q' r0 ~5 A7 c3 j7 y. o
StstemVerilog則後段功力相當了得
  y/ h$ I; ?% X# W: F可惜這兩種標準還無法做有效率的整合
; h$ t, `6 ^$ y學界已經有很好的整合經驗! e5 Z7 P8 n" p8 O
但是業界中小型還在探索階段或根本沒有
* u" d. c0 N  q大型的Design House & Design service company有專門的部門在研究
5 Q8 S) H3 J+ F2 g% |6 P( a但只是部分導入在複雜的SOC上7 s6 f. X- J( q) L4 b- g
總之 越複雜大型的SOC 這種投資就相對顯得重要..
3#
發表於 2013-9-4 17:03:52 | 只看該作者
systemverilog接触多些,systemC现在看到少了
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