Cortex-M0/M3/M4 Source Codes

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Cortex-M0/M3/M4 Source Codes

" B+ G: t! {, H( q1 ^/ n! Y# Aiconstart@gmail.com
* X2 ?( `  a0 \5 P0 m: }
├─AT420-DA-03001-r2p0-00rel0
│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
9 @1 l6 y8 m5 F7 @' I. q+ }│         
├─AT420-DC-02008-r2p0-00rel0
% M: }( F3 ]4 ^│  └─docs
+ }. j+ U& H- }& q3 i' U" P2 ?│          DII0194A_cortex_m3_r2p0_csg.pdf
+ l* B: u4 ]- Q│         
% L  g: i1 [+ R9 b) N├─AT420-DC-13001-r2p0-00rel0
│  └─docs

│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
# o% s% ?6 I; d! \6 f│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
5 x9 a: m& q, z' Z6 C' F│  │  │         
│  │  ├─dapswjdp
9 d! k& D! L/ ?│  │  │  │  README_DAPSWJDP
! m, |5 ?* T( C& H% j& a9 N│  │  │  │  
0 ~# O/ M" c2 P' M│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
1 W4 t* c5 Y8 U# u8 w│  │  │          DAPDpEnSync.v
0 e; A1 T7 t) Z│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
0 s0 d; C: X9 Q) ^! X/ N* o. i2 I│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
. c. D1 D8 o3 l$ \│  │  │          DAPSwDpDefs.v
2 m- a; S9 `+ W; D& q│  │  │          DAPSwDpProtocol.v
- N- }( P5 Y' l8 `│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
/ H* T* f) D8 i; Q0 e0 t  s│  │  │          DAPSwjDpDefs.v
8 K% g8 y- e/ Y% K│  │  │          DAPSwjWatcher.v
│  │  │         
+ b  e8 g' n+ i) ?% K+ M  z/ A│  │  ├─models
2 h, K: `$ s5 U' N3 @│  │  │  └─cells
' L  l) F  @/ ~; L2 M  |1 d+ o│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
+ D7 k( L- c# S, i7 J+ S# }, w│  │  │         
- [4 _% D: c/ J, O│  │  └─tbench
  r0 e# \0 Q+ S: M6 [$ L│  │      └─verilog
2 M- R/ ^8 _4 k5 y( X│  │              AhbToApb.v
( y+ X# Y1 S  v; j5 b% m│  │              AtbLogger.v
- H! ]9 c# s% X/ v' i4 p0 n│  │              BusMatrix.v
7 T# y( d9 _- n0 ?│  │              ClkReset.v
: f9 \6 }& K2 u' Y7 `' t( a│  │              CM3BusComparator.v
$ F  l1 e. @8 s) q
- y) J; p! W& z( B( y7 z- x$ P
- m7 v& {& W( |& w$ r# P& {/ B│      │  │  exclude_list.sc_waitstate
) M4 j3 n0 }) R$ H
             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
1 {2 H1 J% B  ]; h, t$ S, v8 s             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
             │              cells_1.geo
             │              cells_1.pwr
             │              index.cli
# o0 W8 p3 [) M! @3 {' o* c& }9 `             │              README.TXT
0 o# A% y/ Q6 b7 ?1 p9 O             │              rulesets
( P5 X/ A/ ~+ H3 k6 M6 j& h1 E             │              VERSION.TXT
0 k! B: b5 n4 u/ n             │              vias_1.geo
             │              
. F7 W5 `* @! E7 g4 f' o             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
/ [4 C0 H% J+ h1 E! S                     └─6X2Z
2 U& J# _1 Z, s                             corner.defs
" T3 f2 T' Q5 S- b- ~
├─integration_kit
│  ├─logical
- X% G& g/ Q3 k0 R6 H9 u│  │  ├─cm0ikmcu
8 i+ k7 `2 K( m! l│  │  │  └─verilog
│  │  └─tbench
: H2 b% S, u# w& n+ D│  │      └─verilog
1 X/ m( L) ?5 ]- z+ Y│  └─validation
│      ├─glogs
│      ├─logs
. g& L/ |6 U* C/ P  l; K$ v  [│      ├─mdk
* i& w0 \3 X; ?' U% K; w, M% ^│      ├─srpg
/ e( x% B1 {6 ~3 X6 ~6 P│      ├─tests
% T' p4 b3 Z% s$ x9 R; p│      │  └─CMSIS
│      │      └─Core
│      │          ├─CM0
# x3 a6 P6 b+ ~; c8 g$ Y│      │          └─Documentation
/ Q6 C$ Y# _2 }% O7 F│      └─vectors
8 I) \" {% V/ k" D0 n├─ipxact
9 r% n9 j% e6 t) S: e- J│  ├─busdefs
│  │  ├─amba.com
│  │  │  └─AMBA3
0 ^1 z- A5 B* I5 P│  │  └─arm.com
8 b$ @& B5 B6 t' J5 p. i│  │      ├─CoreSight
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