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PMOS Low_Dropout Voltage Regulator Introduction

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1#
發表於 2008-10-1 20:26:02 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
1 Constant-Voltage Source # k9 Z1 E9 s& {
2 Output-Voltage Error vs Load Resistance % d5 R) Z2 ^  Z8 N3 v
3 Linear Relation Between RIN and RLOAD
( K5 U* b6 [& O/ H4 Basic Linear-Voltage Regulator
  @9 Z2 J8 A5 T4 ^) h1 O5 PMOS Enhancement FET " K0 L- x% Z( N4 G1 k3 |* [% i2 o
6 Regulation Sequence When RLOAD Drops 7 Regulator Block Diagram PMOS Input/Output Characteristic
' A" g2 w2 ?2 Y" j2 s! V# [3 [3 T+ h, W0 r
看過後  歡迎討論ㄛ.
# f) t- {7 F6 ?1 h3 {1 s2 d我是看過啦.
" n* N" F0 m! N; D6 n6 L3 ]4 ^+ v

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2#
發表於 2008-10-2 12:31:26 | 只看該作者
這可是好東西,坐沙發耶,linear regulator的pass gate現今的應用,應該99%都是用Pmos(power mos),感謝大大無私分享,3Q~
3#
發表於 2008-10-3 19:51:41 | 只看該作者
想問問 為什麼 PMOS是主流?
4 H; I5 j3 c0 |$ N- Z0 D$ e是否因為  PMOS 可以 Pass Good "1"的關係?
4#
發表於 2009-1-13 00:23:41 | 只看該作者
目前就是在做這個啦!
7 D3 y3 N. z* j; z/ V8 J從高頻降頻下來. B" j5 T( N- k3 [) q
真有點不太習慣3 H% d8 J! W4 Q( Q& O
不過感恩阿
5#
發表於 2009-1-13 00:27:45 | 只看該作者
(科)技最新進
0 e: ~  ?- ~  k(技)術都領先
- ?( ~4 e6 D# Y3 a- H5 w6 |(新)手真是慘
, P; m9 V+ h! [0 I$ P0 W(貧)窮都沒錢
6#
發表於 2009-4-9 00:49:03 | 只看該作者
我們公司就是做這個啦,來了解一下感謝大大的分享阿!!!!!!!
7#
發表於 2009-5-19 07:02:14 | 只看該作者
同样的问题,为什么现在都用PMOS?是不是因为可以获得更加大的VGS?
8#
發表於 2009-10-27 23:35:43 | 只看該作者
下载来看看 下載看看先~~~~~~~~~~9 p2 g5 u5 ~7 Z6 X
下載看看先~~~~~~~% Y+ |% l" Q* `6 X6 l- l
下載看看先
9#
發表於 2009-10-27 23:35:59 | 只看該作者
這幾天正在做LDO8 V+ U* @# c7 S; n/ q* s
正需LDO這方面的知識% Z9 k/ b" {& o9 {! l% ?$ Z3 v3 o
THX大大,辛苦了
10#
發表於 2011-8-25 10:27:22 | 只看該作者
我剛剛看了一下,沒發現我想知道的@@"
' `1 j9 P9 I& Q: z; v如果我想在很低電壓去驅動OP那,我怎麼設計用CMOS四支腳當輸入,. B7 x5 u! O" n' _8 e8 B2 s( Q) @
來產生在低電壓操作的OP~。
11#
發表於 2011-8-25 14:48:41 | 只看該作者
為什麼LDO的輸出是PMOS而非NMOS  我陳述一下自己的想法 不一定正確  歡迎指正~~  8 D8 W2 V4 N6 F' o
如果~LDO的輸出為NMOS的話~那顆NMOS的threshold voltage應該會很大
: Z5 A5 E4 B* h/ P4 c2 S/ Q造成NMOS的 Vgs應該也要很大~這樣LDO的supply voltage 就不能太低 無法工作在低電壓下
12#
發表於 2011-9-21 09:15:29 | 只看該作者
但是LDO原本就是要將輸路的電壓拉低嗎?
+ H% J9 I% _% w7 {# C那怎麼會出現在低電壓操作?
13#
發表於 2011-9-22 09:39:15 | 只看該作者
謝謝分享,小弟來學習一下!
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