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[問題求助] 佈局過程中將輸出、入port定義在metal1 第一層金屬層較合適嗎

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1#
發表於 2007-10-25 16:31:09 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
小妹再畫layout時將schematic中輸出port 建在第2層金屬  以metal2當作輸出port,但學長說最好輸出、入port都以m1第一層來做。8 P* |) E) E' S
所以叫我m2那端再打上contact和m1  ,再將port定義在m1上。
; X3 ]4 J; V1 a' H' a小妹想請教輸出、入port定義在第幾層金屬是否會有影響差別? 還有是否有合適定義在第幾層金屬 ?. e, f  W! p2 S
麻煩大大們 若有空時 能提供經驗分享 ,在此先謝謝^^
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2#
發表於 2007-10-25 17:42:33 | 只看該作者
如果妳畫的是小block,那應該是為了上層整合時比較方便跨線或接線,
" a" ?, `: T  R0 N' ^2 Y不然以metal來說,越下層的電阻越大,又或者妳有包guard ring,如果用* r/ `7 N" i# z1 A0 r3 ~! [
m1的話那勢必將guard ring切開拉線,對guard ring的抗干擾效果會不
% u$ Q( E* C' J: f- }, M" t太好
3#
發表於 2007-10-25 18:37:40 | 只看該作者
嗯~固定在哪個層metal應該不是重點吧~5 [0 G! n! q& X+ B
因為是出Port是要和別的Block互接啊,所以應該考量block和block的關係才是^^) d. h4 H1 \* }; A* a! D( T

! A3 [. U) N. {) q如果你的metal在畫的時候有使用類似Digital的畫法==> M1/M3同方向;M2/M4另一個方向
, H, C! F, n5 M7 V5 I$ r/ ?# w" B那你的出port位置就要和你畫的metal的方向有關囉~這樣在block接起來的時候才不會打架$ ^8 ^7 Z% g; y1 N+ N6 P

% y# X+ [, H" f! Q* {& @再來如果還要再做其它的考量,一般我的畫法會是 digital出比較低層的metal ; analog 出比較高層的metal
/ X: T7 t1 y' r/ {5 ?* g0 v8 i0 W9 i8 D- E* H0 r+ L
結論~port要出哪一層,應該視你的top而定 ^^
7 [8 ^5 ?5 j+ J9 E4 C: M, k" {    至於小 block 要出哪一層,反正在整大block的時候~妳應該會需要再修改一下的1 d7 R2 H' h8 P, p& C
     ==> 除非你的 floor plan 做的很好囉 ^^
4#
 樓主| 發表於 2007-10-25 18:56:55 | 只看該作者
謝謝二位的經驗談^^
4 J; d0 D" z% e+ |% a4 ]  k! M應該是指說看這電路總共有幾層 ,選擇最合適block整合的該層吧...
. o* s, m, A) p2 z; ]8 }  d所以選擇在那層的同時也須考慮到是否像sw5722的說法 即是否會對電路造成什麼影響?8 O6 u& e0 ]1 O* B
還有像您類比電路最後1級block的輸出port是擺較高層吧?如果已考量過方便block連接的層,而發現也可以定義在較低層於是以較低層的metal定義為最後1級block   port的輸出 會因此影響很大嗎? 因為sw5722提到越低層的metal 電阻性越高,小妹現在指經考量過後發現最後1級block port定義在較高或較低層都 方便block之間的整合時,那定義在較高或較低層有差嗎?
4 @9 d& ]" M+ ^# c% D
4 Y5 i# m) N% Z. J; ]5 ][ 本帖最後由 君婷 於 2007-10-25 07:04 PM 編輯 ]
5#
發表於 2007-10-26 11:09:56 | 只看該作者
其實各層metal的電阻相差有限,用哪一層其實沒差很多,除非是
+ g' B6 w2 M) o某條線怕干擾,會用top metal做,因為基底(BULK或subtrate)像
) x& d0 n7 [" v" S化糞池,幾乎所有guard ring吸收的雜訊,都會排到基底,怕干擾
/ W( ^9 e! w/ @7 r+ ^自然離它越遠越好,因為top metal是在最上層.
6#
發表於 2007-12-7 09:52:34 | 只看該作者
出Port 的考量點大致上就這幾點$ a( \/ y, N: R2 `, Z( F
1.與上一層的或其他的Block 相接時,較短路徑的方向和位置2 y- S/ I1 Q5 b
2.出線方向的Metal layer 選用 % ]! P4 s9 J+ s  _5 |. @
   如 H M1/M3/M5" Q% t, g4 p9 G+ E3 v( ^
     V M2/M4/M6
6 z& y$ @  D& w8 S& R  ^3.已知其他對應欲接線 Block 的出pin layer,並調整與之對應.; M" I/ s# q: S! ]
4.提高接線時的方便(彈性),不只出一層Layer. -->For APR常用的技巧/ g, {0 y% `& P% @/ i
5.其他考量如 Noise(選用較高層..),避開Power Ring用的Layer(不然會拉不出去)
7#
發表於 2007-12-24 20:14:13 | 只看該作者
我認為定在M1是比較理想的,這可以從兩方面來看
: B4 v$ m6 P0 V# A' ~1.在TOP layout 時出線會比較好出) ?$ u; f& U0 [) R+ ^
2.若以APR來看,若將port出在M2以上的 metal layer
/ T5 ^! t4 h3 b' a  則將可能會擋住 M2 以上的 metal routing ,這樣將會撐大 route 的面積
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